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標(biāo)簽 > vhdl
VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,誕生于1982年。1987年底,VHDL被IEEE和美國(guó)國(guó)防部確認(rèn)為標(biāo)準(zhǔn)硬件描述語(yǔ)言 。
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基于Altera CPLD的水輪發(fā)電機(jī)組轉(zhuǎn)速監(jiān)控系統(tǒng)的設(shè)計(jì)
電子發(fā)燒友網(wǎng)核心提示 :本文給出了采用CPLD的水輪發(fā)電機(jī)組轉(zhuǎn)速監(jiān)控系統(tǒng)的設(shè)計(jì)原理和VHDL的語(yǔ)言描述,該設(shè)計(jì)具有結(jié)構(gòu)簡(jiǎn)單、成本低和抗干擾性能強(qiáng)等特點(diǎn)。...
基于FPGA在Quartus II軟件中使用VHDL語(yǔ)言,對(duì)單總線溫度傳感器進(jìn)行讀寫(xiě)控制及溫度顯示功能,與傳統(tǒng)方法相比具有硬件電路簡(jiǎn)單、可實(shí)現(xiàn)多路控制的優(yōu)點(diǎn)。
使用CPLD器件和VHDL語(yǔ)言實(shí)現(xiàn)USB收發(fā)模塊的硬件功能設(shè)計(jì)
當(dāng)前,高密度可編程邏輯器件CPLD,由于具有巨大的靈活性而廣泛應(yīng)用于狀態(tài)機(jī)、同步、譯碼、解碼、計(jì)數(shù)、總線接口、串并轉(zhuǎn)換等很多方面,而且在信號(hào)處理領(lǐng)域的應(yīng)...
使用VHDL語(yǔ)言和FPGA技術(shù)實(shí)現(xiàn)高效微控制器內(nèi)核的設(shè)計(jì)
與傳統(tǒng)投片實(shí)現(xiàn)ASIC相比,F(xiàn)PGA具有實(shí)現(xiàn)速度快、風(fēng)險(xiǎn)小、可編程、可隨時(shí)更改升級(jí)等一系列優(yōu)點(diǎn),因而得到了越米越廣泛的應(yīng)用。MCS-51應(yīng)用時(shí)間長(zhǎng)、范圍...
為了提高傳輸速率,擴(kuò)大通信容量,減少信道數(shù)量,通常把多路信號(hào)復(fù)用成一路信號(hào)進(jìn)行傳輸。在多種復(fù)用方式中,時(shí)分復(fù)用是一種常用的方式。時(shí)分復(fù)用是多路信號(hào)按照時(shí)...
基于VHDL語(yǔ)言及SOPC技術(shù)實(shí)現(xiàn)全數(shù)字調(diào)頻信號(hào)發(fā)生器的設(shè)計(jì)
在常用的信號(hào)源及信號(hào)處理設(shè)計(jì)方案中,RC/LC振蕩電路頻率調(diào)整方便,但是它的工作頻率穩(wěn)定度較低。頻率穩(wěn)定度較低導(dǎo)致系統(tǒng)的工作穩(wěn)定度降低,使其不適用于對(duì)精...
2020-08-03 標(biāo)簽:fpgavhdl信號(hào)發(fā)生器 1779 0
基于可編程邏輯器件的數(shù)字電路設(shè)計(jì)
基于可編程邏輯器件的數(shù)字電路設(shè)計(jì) 0 引 言 可編程邏輯器件PLD(Programmable Logic De-vice)是一種數(shù)字電路,它...
采用VHDL實(shí)現(xiàn)有線電視機(jī)頂盒數(shù)據(jù)格式轉(zhuǎn)換的設(shè)計(jì)方案
VHDL是隨著可編輯邏輯器件(PLD)的發(fā)展而發(fā)展起來(lái)的一種硬件描述語(yǔ)言。它是1980年美國(guó)國(guó)防部VHSIC(超高速集成電路)計(jì)劃的一部分,并于1986...
2019-01-11 標(biāo)簽:機(jī)頂盒計(jì)算機(jī)vhdl 1729 0
基于FPGA/CPLD的嵌入式VGA顯示系統(tǒng)設(shè)計(jì)
VGA(Video GraphICs Array)即視頻圖形陣列,是IBM在1987年隨PS/2機(jī)(PS/2 原是Personal System 2的意...
采用單片CPLD器件及VHDL源程序?qū)崿F(xiàn)單個(gè)載客箱的電梯控制系統(tǒng)
隨著社會(huì)的發(fā)展。使用電梯越來(lái)越普遍,已從原來(lái)只在商業(yè)大廈、賓館過(guò)渡到在辦公室、居民樓等多種建筑中,并且對(duì)電梯功能的要求也不斷提高,其相應(yīng)控制方式也在不斷...
Verilog與VHDL的比較 Verilog HDL編程技巧
Verilog 與 VHDL 比較 1. 語(yǔ)法和風(fēng)格 Verilog :Verilog 的語(yǔ)法更接近于 C 語(yǔ)言,對(duì)于有 C 語(yǔ)言背景的工程師來(lái)說(shuō),學(xué)習(xí)...
BSDL文件可以在一些邊界掃描的軟件中被使用,如XJTAG,TopJTAG等等,通過(guò)加載對(duì)應(yīng)的BSDL文件可以實(shí)現(xiàn)對(duì)芯片外部所有管腳的讀取和控制。具體使...
基于FPGA和VHDL語(yǔ)言編程實(shí)現(xiàn)液晶屏信號(hào)發(fā)生器的設(shè)計(jì)
液晶顯示已成為目前平板電視與計(jì)算機(jī)顯示終端的主流,液晶顯示器的研究設(shè)計(jì)、生產(chǎn)、檢驗(yàn)等部門(mén)甚至消費(fèi)者需要用一些定量或定性的方法和指標(biāo)去檢驗(yàn)液晶顯示器的質(zhì)量和特性。
2020-07-10 標(biāo)簽:fpgavhdl信號(hào)發(fā)生器 1632 0
采用VHDL語(yǔ)言在CPLD內(nèi)部編程實(shí)現(xiàn)Flash讀取控制設(shè)計(jì)
本設(shè)計(jì)已實(shí)用于國(guó)家863計(jì)劃“可擴(kuò)展到T比特的高性能IPv4/v6路由器基礎(chǔ)平臺(tái)及實(shí)驗(yàn)系統(tǒng)”項(xiàng)目中。其主要功能是對(duì)主控部分的FPGA讀取Flash進(jìn)行控制。
基于可編程邏輯器件和VHDL語(yǔ)言實(shí)現(xiàn)信號(hào)源的方案設(shè)計(jì)
在高速數(shù)據(jù)采集系統(tǒng)中,信號(hào)源作為一種校驗(yàn)設(shè)備,需要及時(shí)、有效地向采集設(shè)備提供高頻信號(hào),用于檢驗(yàn)數(shù)據(jù)采集器的工作情況;同時(shí)信號(hào)源還應(yīng)該能夠提供一些必要的控...
幾年前設(shè)計(jì)專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計(jì)工程師的事, 隨著硅的集成度不斷提高,百萬(wàn)門(mén)的ASIC 已不難實(shí)現(xiàn), 系統(tǒng)制造公司的設(shè)計(jì)人員正越...
為什么設(shè)計(jì)復(fù)雜系統(tǒng)如此之難?淺談利用仿真攻克汽車系統(tǒng)設(shè)計(jì)
當(dāng)今汽車行業(yè)所面臨的挑戰(zhàn)與電信行業(yè)十多年前所經(jīng)歷的類似?;旌蟿?dòng)力電動(dòng)汽車和燃料電池汽車等新技術(shù)也促進(jìn)了研發(fā)活動(dòng)的日趨活躍,正如我們?cè)谑謾C(jī)演變成多媒體設(shè)備...
2018-02-02 標(biāo)簽:仿真vhdl系統(tǒng)設(shè)計(jì) 1575 0
Verilog和VHDL是兩種廣泛使用的硬件描述語(yǔ)言(HDL),它們用于描述和模擬數(shù)字電路系統(tǒng)的行為和結(jié)構(gòu)。這兩種語(yǔ)言的主要作用是幫助工程師設(shè)計(jì)、仿真和...
采用Spartan2系列FPGA器件實(shí)現(xiàn)全數(shù)字鎖相環(huán)路的設(shè)計(jì)和仿真驗(yàn)證
數(shù)字鎖相環(huán)路已在數(shù)字通信、無(wú)線電電子學(xué)及電力系統(tǒng)自動(dòng)化等領(lǐng)域中得到了極為廣泛的應(yīng)用。傳統(tǒng)的全數(shù)字鎖相環(huán)路(DPLL)是由中、小規(guī)模TTL集成電路構(gòu)成。這...
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