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本文檔的主要內(nèi)容詳細介紹的是FPGA教程之FPGA入門閃爍燈實驗的詳細資料說明。
實驗任務
讓實驗板上的8 個LED 周期性的閃爍。通過這個實驗，熟悉并掌握采用計數(shù)與判斷的方式來實現(xiàn)分頻的Verilog HDL 的編程方法以及Quartus II 軟件的使用方法和開發(fā)流程。
實驗環(huán)境
硬件實驗環(huán)境為艾米電子工作室型號EP2C8Q208 增強版開發(fā)套件。軟件實驗環(huán)境為Quartus II 8.1 開發(fā)軟件。
實驗原理
艾米電子工作室開發(fā)套件板載50MHz 的時鐘源，假如我們直接把它輸入到發(fā)光二極管LED，由于人眼的延遲性，我們將無法看到LED 閃爍，認為它一直亮著。如果我們期望看到閃爍燈，就需要將時鐘源的頻率降低后再輸出。本實驗采用計數(shù)與判段的方式來實現(xiàn)降低時鐘源的頻率。計數(shù)電路可用計數(shù)器實現(xiàn)，每來一個時鐘脈沖CLK，計數(shù)器就加1，而每當判斷出計數(shù)器達到某個數(shù)值時，把輸出狀態(tài)求反，就使得8 個LED 的亮滅反轉(zhuǎn)一次，即：周期性的輸出高電平“1”和低電平“0”。這樣設計相當于把50MHz 的時鐘源分頻后輸出。如果最終要使得LED 1S 閃爍一次，即輸出1Hz 的時鐘脈沖，讓計數(shù)器計到25000000 便可以讓LED 亮0.5 秒、滅0.5 秒。
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