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淺談人工智能工作負(fù)載對(duì)處理器設(shè)計(jì)的影響
人工智能還可能在小芯片領(lǐng)域發(fā)揮重要作用,在那里,半定制和定制硬件模塊可以被表征并添加到設(shè)計(jì)中,而無(wú)需從頭開(kāi)始創(chuàng)建一切。英特爾和AMD等大型芯片制造商...
如何使用One Spin檢查AMD Vivado Design Suite Synth的結(jié)果
本文講述了如何使用 One Spin 檢查 AMD Vivado Design Suite Synth 的結(jié)果(以 Vivado 2024.2 為例)。
AMD Versal Adaptive SoC Clock Wizard AXI DRP示例
本文將使用 Clocking Wizard 文檔 PG321 中的“通過(guò) AXI4-Lite 進(jìn)行動(dòng)態(tài)重配置的示例”章節(jié)作為參考。
一方面AMD的半定制芯片領(lǐng)域?qū)?huì)是未來(lái)人工智能領(lǐng)域公司的重點(diǎn)投入方向之一,因?yàn)槿斯ぶ悄軕?yīng)用的大客戶(主要是互聯(lián)網(wǎng)科技巨頭)對(duì)于這個(gè)領(lǐng)域有非常大的興趣
TPS536C5 用于AMD平臺(tái)的 12 相數(shù)字降壓多相控制器數(shù)據(jù)手冊(cè)
TPS536C5 是一款完全符合 AMD SVI3 標(biāo)準(zhǔn)的降壓控制器,具有雙通道、內(nèi)置非易失性存儲(chǔ)器 (NVM) 和 PMBus? 接口,并與 TI N...
對(duì)于正處于戰(zhàn)略轉(zhuǎn)型期的AMD而言,將在海外舉辦多年的APU技術(shù)創(chuàng)新大會(huì)首次移師中國(guó)北京,無(wú)疑凸顯了大中華區(qū)舉足輕重的戰(zhàn)略地位。
摩爾定律放緩后,AMD都迎來(lái)了哪些創(chuàng)新呢?
AMD XDNA XDNA帶有本地存儲(chǔ)器和數(shù)據(jù)移動(dòng)器的高度可擴(kuò)展引擎陣列,是AMD利用深厚的FPGA和自適應(yīng)SOC編譯算法專業(yè)知識(shí)推出的一種算法工具。
使用ALINX VD100開(kāi)發(fā)板實(shí)現(xiàn)圖像處理
這是一塊基于 AMD Versal Edge AI 平臺(tái)的開(kāi)發(fā)板,功能特別強(qiáng)大,可以用來(lái)做圖像處理、人工智能等各種高階應(yīng)用。
Xilinx Shift RAM IP 是 AMD Xilinx 提供的一個(gè) LogiCORE IP 核,用于在 FPGA 中實(shí)現(xiàn)高效的移位寄存器(Sh...
QDMA Subsystem for PCI Express v5.0產(chǎn)品指南
AMD QDMA Subsystem for PCI Express( PCIe )旨在利用多隊(duì)列的概念實(shí)現(xiàn)高性能 DMA,以搭配 PCI Expres...
2025-05-13 標(biāo)簽:amd存儲(chǔ)器UltraScale 304 0
利用AMD VERSAL自適應(yīng)SoC的設(shè)計(jì)基線策略
您是否準(zhǔn)備將設(shè)計(jì)遷移到 AMD Versal 自適應(yīng) SoC?設(shè)計(jì)基線是一種行之有效的時(shí)序收斂方法,可在深入研究復(fù)雜的布局布線策略之前,幫您的 RTL ...
Versal 600G DCMAC Subsystem LogiCORE IP產(chǎn)品指南
AMD 自適應(yīng)計(jì)算文檔按一組標(biāo)準(zhǔn)設(shè)計(jì)進(jìn)程進(jìn)行組織,以便幫助您查找當(dāng)前開(kāi)發(fā)任務(wù)相關(guān)的內(nèi)容。您可以在設(shè)計(jì)中心頁(yè)面上訪問(wèn) AMD Versal 自適應(yīng) SoC...
本文講述了AMD UltraScale /UltraScale+ FPGA 原生模式下,異步模式與同步模式的對(duì)比及其對(duì)時(shí)鐘設(shè)置的影響。
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