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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>VHDL設(shè)計(jì)風(fēng)格和實(shí)現(xiàn)

      VHDL設(shè)計(jì)風(fēng)格和實(shí)現(xiàn)

      2018-03-16 | rar | 0.42 MB | 次下載 | 免費(fèi)

      資料介紹

      　　同步設(shè)計(jì)：上游數(shù)據(jù)到下游邏輯單元的傳遞是通過時鐘來同步的。只要能滿足時延要求，就可以確保下游邏輯單元能正確采樣到上游數(shù)據(jù)。

      　　異步設(shè)計(jì)：上游數(shù)據(jù)發(fā)生變化的時機(jī)是不確定的，甚至?xí)霈F(xiàn)中間態(tài)。 下游邏輯對上游數(shù)據(jù)的采樣是不確定的，會發(fā)生數(shù)據(jù)傳遞的錯誤。

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