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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>使用VHDL實(shí)現(xiàn)數(shù)字電路設(shè)計(jì)的詳細(xì)資料說明

      使用VHDL實(shí)現(xiàn)數(shù)字電路設(shè)計(jì)的詳細(xì)資料說明

      2021-01-21 | rar | 1.18 MB | 次下載 | 免費(fèi)

      資料介紹

      本文檔的主要內(nèi)容詳細(xì)介紹的是使用VHDL實(shí)現(xiàn)數(shù)字電路設(shè)計(jì)的詳細(xì)資料說明包括了：ASIC技術(shù)的發(fā)展，電路系統(tǒng)設(shè)計(jì)方法，自定向下的設(shè)計(jì)流程，設(shè)計(jì)描述風(fēng)格。

      　　由于所設(shè)計(jì)的系統(tǒng)的規(guī)模已從幾十幾百門增加到幾萬幾十萬門，使得從前電子工程師所熟悉的畫電路圖、真值表和卡諾圖的設(shè)計(jì)方法已經(jīng)遠(yuǎn)遠(yuǎn)不能滿足數(shù)字系統(tǒng)的復(fù)雜性要求

      　　高層次設(shè)計(jì)方法──HLD（High Level Design）是從八十年代末以來，最新專用集成電路設(shè)計(jì)的、最先進(jìn)的設(shè)計(jì)方法，它為用戶設(shè)計(jì)更大規(guī)模、更高水平、性能優(yōu)良的數(shù)字系統(tǒng)提供了可靠的保證

      　　HLD符合目前對(duì)電路的兩個(gè)要求

      　　Time to MarketiteaokTmM ：對(duì)于通信領(lǐng)域來說，快速推出市場(chǎng)需要的系統(tǒng)具有非常重要的價(jià)值，HLD使得快速設(shè)計(jì)較大的芯片成為可能。

      　　SOC：目前對(duì)數(shù)子系統(tǒng)的需求是規(guī)模越來越大，HLD非集成電路專業(yè)背景的通信廠商設(shè)計(jì)大規(guī)模芯片提供了可能

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