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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用CPLD實(shí)現(xiàn)Watchdog功能

      如何使用CPLD實(shí)現(xiàn)Watchdog功能

      2019-06-12 | rar | 0.26 MB | 次下載 | 免費(fèi)

      資料介紹

      　　1 實(shí)現(xiàn)原理

      　　CPLD實(shí)現(xiàn)Watchdog 功能，通過(guò)對(duì)寄存器的操作，實(shí)現(xiàn)Watchdog各項(xiàng)功能。CPLD 內(nèi)部Watchdog 模塊邏輯框圖如下所示。

      　　Wdt_wdi 為喂狗信號(hào)，電平跳變則清除看門(mén)狗溢出計(jì)數(shù)器計(jì)時(shí)。

      　　Wdt_off 為強(qiáng)制關(guān)狗信號(hào)，屏蔽看門(mén)狗溢出輸出。

      　　Wdt_rst_force 用于強(qiáng)制輸出復(fù)位信號(hào)。

      　　Wdt_off_1min_pulse 用于強(qiáng)制關(guān)閉看門(mén)狗1分鐘。

      　　Wdt_rst 用于輸出復(fù)位脈沖信號(hào)。

      　　Wdt_off_1min_on 用于輸出1分鐘關(guān)狗的狀態(tài)，表示是否處于1min關(guān)閉看門(mén)狗狀態(tài)中。

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