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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的JPEG硬件解碼器設(shè)計(jì)

      基于FPGA的JPEG硬件解碼器設(shè)計(jì)

      2011-05-10 | pdf | 556 KB | 次下載 | 免費(fèi)

      資料介紹

      ?

      JPEG 靜態(tài)圖像壓縮標(biāo)準(zhǔn)是1992 年才發(fā)展起來(lái)的一套圖像壓縮解壓縮協(xié)議。但是在短短的十年里取得了巨大的成功?，F(xiàn)在幾乎成為靜態(tài)圖像的標(biāo)準(zhǔn)壓縮解壓協(xié)議。得到了極為廣泛的應(yīng)用。JPEG 標(biāo)準(zhǔn)中最簡(jiǎn)單的BaseLine 模式大致有10：1 的壓縮率，可以大大減少圖像的存儲(chǔ)空間。以10：1 壓縮率解壓的圖像，能夠很好保證圖像的視覺(jué)效果。所以，在工業(yè)設(shè)計(jì)中，人們的日常生活中越來(lái)越多的使用到JPEG 圖像。
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