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Vivado防止信號被綜合掉的三種方法

FPGA學(xué)習(xí)交流 ? 2018-06-01 16:59 ? 次閱讀
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1、 信號前面將keep hierarchy選擇YES ,或者選擇soft(在綜合時保持層次),這樣有利于你從模塊中找到你想抓取的信號和信號名不被更改。

2、 信號前面使用 (* KEEP = “{TRUE|FALSE |SOFT}” *),可以防止信號被綜合掉,但是無法防止在布局布線的時候優(yōu)化掉。

3、 信號前面使用(* DONT_TOUCH= “{TRUE|FALSE}” *),可以防止信號在綜合,以及布局布線的時候被優(yōu)化掉。

注意: 右邊的TRUE|FALSE必須要大寫,否則會報錯,無法識別TRUE|FALSE為1|0.

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