提高Xilinx FPGA Flash下載速度
最近在編寫完FPGA邏輯，成功生成.bin文件后，發(fā)現(xiàn)將數(shù)據(jù)流文件燒寫到Flash時間過長，突然想起可以通過Vivado軟件進(jìn)行設(shè)置，提高燒寫速度。操作如下：
（1）布局布線完成后，點擊Open Implementation。
（2）點擊Tool-----> Edit Device Properties...
（3）General ----->Enable Bitstream Compression ----->TRUE，選擇壓縮數(shù)據(jù)流，提高下載速度。
（4）Configuration -------> Configuration Rate(MHz)，可以選擇較大的CCLK時鐘值。（如果配置I/O PCB布線不佳，較大的時鐘可能會導(dǎo)致FLASH燒寫失敗，此時需要降低CCLK時鐘）
點擊OK，并點擊“保存”菜單，保存當(dāng)前配置。
打開.xdc約束文件，我們可以看到新增以下內(nèi)容：
完成以上操作，重新生成bit文件及bin文件即可實現(xiàn)加快FLASH燒寫速度。
審核編輯：湯梓紅
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原文標(biāo)題：提高Xilinx FPGA Flash下載速度
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