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標簽 > xilinx
Xilinx是全球領先的可編程邏輯完整解決方案的供應商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設計工具以及作為預定義系統(tǒng)級功能的IP(Intellectual Property)核。
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為PCIe IP選擇GT Quads時,Xilinx建議您在最靠近PCIe硬塊的地方使用GT Quad。雖然這不是必要時,它將改善設計的位置,路線和時間。
Xilinx基于ARM的Zynq-7000和Zynq UltraScale+ MPSoC及RFSoC器件是否存在安全漏洞
本文試圖搞清楚在 Xilinx 基于 ARM 的 Zynq-7000、Zynq UltraScale+ MPSoC 和 Zynq UltraScale+...
閑談Vitis AI|DPU在UltraScale平臺下的軟硬件流程(1)
本篇中,我想跳過一些細枝末節(jié), 先簡單介紹 AMD Xilinx Vitis AI 在 Zynq 這個硬件加速平臺下軟硬件開發(fā)的基本思路和流程,把各個開...
XRT 自2021.1更新后,原有的 XRT Tool指令發(fā)生了一些變化。包括xbmgmt,xclbinutil,xbutil,xbflash2(sta...
2023-01-11 標簽:amdXilinx操作系統(tǒng) 2792 0
Xilinx FPGA IP之Block Memory Generator AXI接口說明
之前的文章對Block Memory Generator的原生接口做了說明和仿真,本文對AXI接口進行說明。
空間輻射環(huán)境中的帶電粒子會導致航天器電子系統(tǒng)的半導體器件發(fā)生單粒子效應,嚴重影響航天器的可靠性和壽命,其中高能質子和重離子是導致單粒子效應的主要因素。...
Xilinx的社區(qū)教育生態(tài)系統(tǒng)
Xilinx的社區(qū)參與企業(yè)戰(zhàn)略圍繞著教育,與非營利組織合作,為Xilinx員工關聯和活躍的學校提供??支持。
如何創(chuàng)建AXI CDMA Linux用戶空間示例應用
本篇博文將為您演示如何創(chuàng)建 AXI CDMA Linux 用戶空間示例應用。 示例設計將在 Zynq UltraScale+ RFSoC ZCU111 ...
作者:Alex He,Xilinx 嵌入式技術專家 Xilinx 嵌入式技術專家 Alex He 與大家分享在Docker里玩轉PetaLinux的上手...
2020-12-25 標簽:LinuxXilinx嵌入式開發(fā)板 2778 0
fpga內部主要結構及其功能分析(Kintex-7FPGA內部結構)
Kintex-7 FPGA的內部結構相比傳統(tǒng)FPGA的內部結構嵌入了DSP48E1,PCIE,GTX,XADC,高速IO口等單元,大大提升了FPGA的性能。
如何借助Xilinx FPGA和MATLAB技術加速機器學習應用
本演講將結合FPGA在機器學習的發(fā)展趨勢、應用和需求,特別介紹在基于MATLAB?完成深度學習算法設計后,FPGA在機器學習方面的技術優(yōu)勢和特點,并將介...
Distributed Memory Generator IP核簡介
Distributed Memory Generator IP 核采用 LUT RAM 資源創(chuàng)建各種不同的存儲器結構。IP可用來創(chuàng)建只讀存儲器 (ROM...
視頻圖像系統(tǒng)正在朝更多像素、更高分辨率和更豐富色彩的方向飛速演變,4K視頻系統(tǒng)尚未大規(guī)模普及,8K視覺就已悄然而至。此前,Image Matter、i...
選擇VCS,再指定庫文件存放的路徑;如果VCS的環(huán)境變量設置好了,那么會自動跳出Simulator executable path的路徑的。
基于Xilinx Zynq SoC器件的D類音頻功率放大器系統(tǒng)設計
音頻放大器的目的是以要求的音量和功率水平在發(fā)聲輸出元件上重新產生真實、高效和低失真的輸入音頻信號,音頻頻率范圍約為20Hz~20KHz,因此放大器必須在...
XILINX FPGA IP之FIFO Generator例化仿真
上文XILINX FPGA IP之FIFO對XILINX FIFO Generator IP的特性和內部處理流程進行了簡要的說明,本文通過實際例子對該I...
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