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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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使用Xilinx Vivado設(shè)計(jì)套件創(chuàng)建一個(gè)簡(jiǎn)單的HelloWorld項(xiàng)目
Xilinx以制造 可編程門陣列(FPGA)而聞名,它是基于一個(gè)通過可編程接點(diǎn)連接的可配置邏輯塊(CLBs)矩陣。根據(jù)Control Engineeri...
Accolade推出的第三代ANIC-200Ku數(shù)據(jù)包處理功能與應(yīng)用領(lǐng)域分析
Accolade推出了第三代雙端口100G網(wǎng)絡(luò)ANIC-200Ku PCIe無損數(shù)據(jù)包采集適配器,該板卡是基于Xilinx UltraScale FPG...
使用AXI VIP的幾個(gè)關(guān)鍵步驟及常見功能
AXI總線在FPGA設(shè)計(jì)中使用越來越頻繁,但初學(xué)的同學(xué)經(jīng)常會(huì)因?yàn)閷?duì)協(xié)議的理解不夠深入,寫出來的代碼經(jīng)常會(huì)出現(xiàn)死鎖等問題,對(duì)FPGA設(shè)計(jì)與調(diào)試帶來很多不必...
基于Xilinx 7系列GTX高速收發(fā)器的初步調(diào)試方案
本來寫了一篇關(guān)于高速收發(fā)器的初步調(diào)試方案的介紹,給出一些遇到問題時(shí)初步的調(diào)試建議。但是發(fā)現(xiàn)其中涉及到很多概念。逐一解釋會(huì)導(dǎo)致文章過于冗長(zhǎng)。所以單獨(dú)寫一篇...
Xilinx FFT IP核功能?實(shí)現(xiàn)介紹與仿真
FFT算法是計(jì)算DFT的高效算法。算法最初由J.W.Cooley和J.W.Tukey于1965年提出,之后又有新的算法不斷涌現(xiàn),總的來說發(fā)展方向有兩個(gè):...
Virtex-7 FPGA系列旨在滿足寬帶通信、高階無線基礎(chǔ)設(shè)施、高端數(shù)字廣播、雷達(dá)圖像處理及其它航空航天和軍用產(chǎn)品等關(guān)鍵細(xì)分市場(chǎng)應(yīng)用需求。Virtex...
Xilinx-vivado的網(wǎng)表形式有edf和dcp兩個(gè)方式,兩個(gè)方式各有不同。對(duì)于仿真來說,兩者均需轉(zhuǎn)換為verilog的形式進(jìn)行仿真,只是使用的命令不同。
以Xilinx的ZYNQ的7000系列為例,介紹CLB功能與結(jié)構(gòu)
CLB是指可編程邏輯功能塊(Configurable Logic Blocks),顧名思義就是可編程的數(shù)字邏輯電路。CLB是FPGA內(nèi)的三個(gè)基本邏輯單元...
Xilinx的方案有現(xiàn)成的參考設(shè)計(jì)XAPP485/486.后來調(diào)試了一下,總是發(fā)現(xiàn)圖像邊緣地方部分區(qū)域是亮的,后來lvds的并上匹配電阻后,顯示就OK了...
使用Xilinx 20nm工藝的UltraScale FPGA來降低功耗的19種途徑
在絕大部分使用電池供電和插座供電的系統(tǒng)中,功耗成為需要考慮的第一設(shè)計(jì)要素。Xilinx決定使用20nm工藝的UltraScale器件來直面功耗設(shè)計(jì)的挑戰(zhàn)...
2018-07-14 標(biāo)簽:xilinxultrascale 6203 0
ARM+FPGA開發(fā):基于AXI總線的GPIO IP創(chuàng)建
FPGA+ARM是ZYNQ的特點(diǎn),那么PL部分怎么和ARM通信呢,依靠的就是AXI總線。這個(gè)實(shí)驗(yàn)是創(chuàng)建一個(gè)基于AXI總線的GPIO IP,利用PL的資源...
xilinx sp605 PCIe EDK使用方法(之一:EDK設(shè)置部分)視頻教程
在EDK環(huán)境中針對(duì)在xilinx sp605 PCIe開發(fā)板,舉一個(gè)簡(jiǎn)單的例子,介紹如何使用PCIE核與PC進(jìn)行數(shù)據(jù)通訊。
DDR3 SDRAM控制器IP核的寫命令和寫數(shù)據(jù)間關(guān)系講解
1. 背景 這篇文章主要介紹了DDR3IP核的寫實(shí)現(xiàn)。 2. 寫命令和數(shù)據(jù)總線介紹 DDR3 SDRAM控制器IP核主要預(yù)留了兩組總線,一組可以直接綁定...
關(guān)于高阻態(tài)和OOC(out of context)綜合方式
Xilinx Vivado工具支持僅將系統(tǒng)設(shè)計(jì)的一部分進(jìn)行綜合,即OOC(out of context)綜合方式。OOC綜合方式的流程就是將設(shè)計(jì)的某個(gè)模...
基于FPGA 的SHA-256 安全認(rèn)證設(shè)計(jì)
Alcatraz (MAXREFDES34#) 子系統(tǒng)提供了一個(gè)參考設(shè)計(jì),用于保護(hù) Xilinx FPGA 以保護(hù) IP 并防止附加的外設(shè)偽造。該系統(tǒng)在...
全面講解FFT在Xilinx FPGA上的實(shí)現(xiàn)
Vivado的FFT IP核支持多通道輸入(Number of Channels)和實(shí)時(shí)更改FFT的點(diǎn)數(shù)(Run Time Configurable T...
2022-09-07 標(biāo)簽:fpgaXilinx數(shù)字信號(hào)處理 6044 0
Xilinx UltraScale+ 器件集成 MIPI D-PHY
無論您正在設(shè)計(jì)的處理系統(tǒng)是用于汽車、物聯(lián)網(wǎng),還是用于 VR/AR 應(yīng)用,符合 MIPI 標(biāo)準(zhǔn)的傳感器及顯示器均是實(shí)現(xiàn)可擴(kuò)展性、高抗噪性及高抖動(dòng)容限的必要條件。
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