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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

verilog語言基本語句_verilog語言詞匯大全

Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為...

2018-03-23 標(biāo)簽：verilog verilog語言 9.6萬 1

Verilog generate語句的類型

Generate 結(jié)構(gòu)在創(chuàng)建可配置的RTL的時(shí)候很有用。Generate loop能夠讓語句實(shí)例化多次，通過index來控制。而conditio...

2018-03-16 標(biāo)簽：Verilog 2.2萬 0

關(guān)于Verilog語言標(biāo)準(zhǔn)層次問題

關(guān)于Verilog語言的官方標(biāo)準(zhǔn)全稱是《IEEE Std 1364-2001：IEEE Standard Verilog? Hardware Descr...

2018-07-06 標(biāo)簽：verilog 編程語言 5186 0

Verilog實(shí)現(xiàn)74LS194芯片設(shè)計(jì)程序

Verilog作為一種種硬件描述語言目前已經(jīng)得到了普遍運(yùn)用。本文主要介紹了Verilog特點(diǎn)、Verilog用途以及Verilog實(shí)現(xiàn)74LS194芯片...

2017-12-22 標(biāo)簽：Verilog 74LS194 7055 0

Verilog/VHDL語法學(xué)習(xí)是掌握基本代碼設(shè)計(jì)的技能以及經(jīng)驗(yàn)總結(jié)

無論是VHDL還是Verilog，建議初學(xué)者先掌握其中一門。

2017-12-19 標(biāo)簽：fpga verilog vhdl 7505 0

d觸發(fā)器verilog描述

觸發(fā)器是一個(gè)具有記憶功能的，具有兩個(gè)穩(wěn)定狀態(tài)的信息存儲(chǔ)器件，是構(gòu)成多種時(shí)序電路的最基本邏輯單元，也是數(shù)字邏輯電路中一種重要的單元電路。在數(shù)字系統(tǒng)和計(jì)算機(jī)...

2017-12-12 標(biāo)簽：verilog d觸發(fā)器 8066 0

verilog實(shí)現(xiàn)定時(shí)器函數(shù)

使用Verilog描述硬件的基本設(shè)計(jì)單元是模塊（module）。構(gòu)建復(fù)雜的電子電路，主要是通過模塊的相互連接調(diào)用來實(shí)現(xiàn)的。模塊被包含在關(guān)鍵字module...

2017-12-08 標(biāo)簽：verilog c語言 1.0萬 0

基于Verilog的PS/2接口控制程序

通過Verilog編程實(shí)現(xiàn)在紅色颶風(fēng)II代Xilinx開發(fā)板上面實(shí)現(xiàn)對(duì)鍵盤、LCD、RS-232等接口或者器件進(jìn)行控制，將有鍵盤輸入的數(shù)據(jù)在LCD上面顯...

2017-11-22 標(biāo)簽：verilog rs232 3406 0

通過編寫verilog代碼實(shí)現(xiàn)OLED驅(qū)動(dòng)和內(nèi)容顯示的解決方案

本實(shí)驗(yàn)通過verilog代碼的編寫，在EGO1開發(fā)板上實(shí)現(xiàn)OLED的驅(qū)動(dòng)和內(nèi)容顯示。

2017-11-11 標(biāo)簽：OLED Verilog OLED驅(qū)動(dòng) 2.0萬 1

改變數(shù)字硬件設(shè)計(jì)，實(shí)現(xiàn)真正工程化

與VHDL和Verilog一樣，SpinalHDL可用于通過定義寄存器和門來描述硬件，SpinalHDL不使用眾所周知的事件驅(qū)動(dòng)范式來描述硬件（如VHD...

2017-08-10 標(biāo)簽：verilog 數(shù)字電路智能硬件 3181 3

基于Verilog FPGA 流水燈設(shè)計(jì)

流水廣告燈主要應(yīng)用于LED燈光控制。通過程序控制LED的亮和滅，多個(gè)LED燈組成一個(gè)陣列，依次逐個(gè)點(diǎn)亮的時(shí)候像流水一樣，所以叫流水燈。由于其形成美觀大...

2017-08-09 標(biāo)簽：fpga verilog 流水燈 1.7萬 0

Verilog的語言要素

本章介紹Verilog HDL的基本要素，包括標(biāo)識(shí)符、注釋、數(shù)值、編譯程序指令、系統(tǒng)任務(wù)和系統(tǒng)函數(shù)。另外，本章還介紹了Verilog硬件描述語言中的兩種...

2017-02-11 標(biāo)簽：FPGA Verilog 2223 0

Verilog HDL簡明教程(2)

模塊是Verilog 的基本描述單位，用于描述某個(gè)設(shè)計(jì)的功能或結(jié)構(gòu)及其與其他模塊通信的外部端口。

2017-02-11 標(biāo)簽：Verilog HDL 1334 0

寫verilog代碼要有硬件的概念

因?yàn)閂erilog是一種硬件描述語言，所以在寫Verilog語言時(shí)，首先要有所要寫的module在硬件上如何實(shí)現(xiàn)的概念，而不是去想編譯器如何去解釋這個(gè)m...

2017-02-11 標(biāo)簽：FPGA verilog 2986 0

初學(xué)者學(xué)習(xí)Verilog HDL的步驟和經(jīng)驗(yàn)技巧

Verilog HDL是一種硬件描述語言（HDL:Hardware Discription Language），Verilog HDL語言是一種以文本形...

2017-02-11 標(biāo)簽：Verilog HDL VHDL 3.7萬 1

一個(gè)合格FPGA 工程師的基本要求

一個(gè)合格的FPGA工程師需要掌握哪些知識(shí)？這里根據(jù)自己的一些心得總結(jié)一下，其他朋友可以補(bǔ)充啊。

2017-02-11 標(biāo)簽：FPGA Verilog 5348 0

FPGA開發(fā)與學(xué)習(xí)連載4

Verilog中，用always塊設(shè)計(jì)組合邏輯電路時(shí)，在賦值表達(dá)式右端參與賦值的所有信號(hào)都必須在always @(敏感電平列表)中列出,always中i...

2017-02-11 標(biāo)簽：FPGA Verilog 613 0

FPGA開發(fā)與學(xué)習(xí)連載：Verilog設(shè)計(jì)經(jīng)驗(yàn)談

Verilog中，用always塊設(shè)計(jì)組合邏輯電路時(shí)，在賦值表達(dá)式右端參與賦值的所有信號(hào)都必須在 always @(敏感電平列表)中列出,always中...

2017-02-11 標(biāo)簽：FPGA Verilog 986 0

Verilog的兩個(gè)誤區(qū)

Reg類型只在過程塊中被賦值;而Net類型則在過程塊外面被賦值或者驅(qū)動(dòng).

2017-02-11 標(biāo)簽：Verilog 2417 0

用Verilog語言實(shí)現(xiàn)奇數(shù)倍分頻電路3分頻、5分頻、7分頻 9

分頻器是FPGA設(shè)計(jì)中使用頻率非常高的基本設(shè)計(jì)之一，盡管在目前大部分設(shè)計(jì)中，廣泛使用芯片廠家集成的鎖相環(huán)資源，如賽靈思（Xilinx）的DLL.來進(jìn)行時(shí)...

2017-02-11 標(biāo)簽：Verilog 分頻電路 1.2萬 0

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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