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PCI-Express（peripheral component interconnect express）是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn)，它原來(lái)的名稱為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線標(biāo)準(zhǔn)。

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pcie技術(shù)

Flow Control機(jī)制可以顯著地提高總線的傳輸效率

PCIe Spec規(guī)定，PCIe設(shè)備的每一個(gè)端口（Ports）都必須支持Flow Control機(jī)制，在發(fā)送TLP之前，F(xiàn)low Control必須先檢...

2018-05-24 標(biāo)簽：總線 PCIe 7484 0

PCIe總線必須要先完成Flow Control初始化

由于VC0是默認(rèn)使能的，所以當(dāng)Flow Control初始化開(kāi)始時(shí)，其會(huì)被自動(dòng)的初始化。其他的Virtual Channel是可選的，只有當(dāng)被配置為使能...

2018-05-24 標(biāo)簽：總線 PCIe 數(shù)據(jù)鏈路層 8296 0

xilinx sp605 PCIe EDK使用方法（之一：EDK設(shè)置部分）視頻教程

在EDK環(huán)境中針對(duì)在xilinx sp605 PCIe開(kāi)發(fā)板，舉一個(gè)簡(jiǎn)單的例子，介紹如何使用PCIE核與PC進(jìn)行數(shù)據(jù)通訊。

2018-06-07 標(biāo)簽：fpga Xilinx PCIe 6177 0

ise設(shè)計(jì)流程視頻教程

xilinx的ise的使用流程，簡(jiǎn)單介紹

2018-06-06 標(biāo)簽：fpga Xilinx PCIe 3966 0

演示如何使用ISE開(kāi)發(fā)FPGA項(xiàng)目（1）視頻教程

作為一個(gè)初學(xué)者，有的時(shí)候很難弄清楚ISE如何使用，本視頻教程以一種最簡(jiǎn)單的方式展示如何使用ISE來(lái)開(kāi)發(fā)一個(gè)XILINX FPGA工程。由于錄屏的原因，本...

2018-06-06 標(biāo)簽：fpga Xilinx PCIe 6692 0

Xilinx DSP解決方案- SysGen 8.1視頻教程

我們將一起從頭至尾復(fù)習(xí)一遍Xilinx DSP的整個(gè)設(shè)計(jì)流程。其中將討論各種設(shè)計(jì)技巧，包括黑盒子，HDL協(xié)同仿真，硬件協(xié)同仿真?？催^(guò)下面的演示，您在半個(gè)...

2018-06-06 標(biāo)簽：dsp fpga Xilinx 4216 0

一個(gè)簡(jiǎn)單的Byte Enable使用的例子

TLP的類型和路由方式由Fmt和Type所決定，這在前面關(guān)于TLP路由的文章中已經(jīng)詳細(xì)的介紹過(guò)。上圖顯示的是各種不同格式的TLP Header的相同的部分。

2018-05-17 標(biāo)簽：電平 PCIe TLP 9769 0

實(shí)測(cè)：高性能PCIe通道固態(tài)硬盤(pán)帶來(lái)的實(shí)際影響

這幾款游戲都是目前比較熱門(mén)的游戲大作，有著大型的場(chǎng)景需要加載。因此測(cè)試以點(diǎn)擊進(jìn)入游戲開(kāi)始計(jì)時(shí)，到完全進(jìn)入可操作界面為止，分別進(jìn)行時(shí)間統(tǒng)計(jì)。

2018-05-16 標(biāo)簽：PCIe 固態(tài)硬盤(pán) 1.9萬(wàn) 0

分析一下PortB的Header中的Base & Limit寄存器

需要注意的是，Endpoint的需要的NP-MMIO的大小明明只有4KB，PortB的Header卻給其1MB的空間（最小1MB），也就是說(shuō)剩余的空間都...

2018-05-11 標(biāo)簽：寄存器 PCIe 6939 0

一些關(guān)于TLP路由的基礎(chǔ)知識(shí)

可能有的人要有疑惑了，既然Message可以使用地址路由或者ID路由，為什么還要單獨(dú)搞出來(lái)一個(gè)模糊路由呢？原因很簡(jiǎn)單，使用模糊路由可以廣播Message...

2018-05-11 標(biāo)簽：總線 PCIe tlp 8192 0

幾個(gè)簡(jiǎn)單的例子來(lái)熟悉寄存器BAR的機(jī)制

Step1：如圖中（1）所示，未初始化的BAR的低比特（11~4）都是0，高比特（31~12）都是不確定的值。所謂初始化，就是系統(tǒng)（軟件）向整個(gè)BAR都...

2018-05-09 標(biāo)簽：寄存器 PCIe 6855 1

Type0和Type1型配置請(qǐng)求

如果不相等，但是在自己的下一級(jí)總線號(hào)（Secondary Bus Number）和最后一級(jí)總線號(hào)（Subordinate Bus Number）之間，則...

2018-05-06 標(biāo)簽：PCIe type 7081 0

轉(zhuǎn)向32GT/s速度的PCIe設(shè)計(jì)所面臨的挑戰(zhàn)

歷史上，PCIe系統(tǒng)設(shè)計(jì)人員把通用低成本FR4 PCB材料和引線鍵合（wirebond）封裝用于高達(dá) 8GT/s 數(shù) 據(jù) 速率（Gen3）的大多數(shù)應(yīng)用...

2018-05-04 標(biāo)簽：印刷電路板 CPU PCIe 7952 0

PCIe的Spec中明確規(guī)定只有Root有權(quán)限發(fā)起配置請(qǐng)求

處理器一般不能夠直接發(fā)起配置讀寫(xiě)請(qǐng)求，因?yàn)槠渲荒墚a(chǎn)生Memory Request和IO Request。這就意味著Root必須要將處理器的相關(guān)請(qǐng)求轉(zhuǎn)換為...

2018-05-04 標(biāo)簽：PCIe Root 7270 0

BDF與配置空間

前面的關(guān)于PCI總線的文章介紹過(guò)PCI總線的配置空間，PCIe總線為了兼容這些PCI設(shè)備，幾乎完整的保留了PCI總線的配置空間。并將配置空間擴(kuò)展到4KB...

2018-05-03 標(biāo)簽：總線 PCIe 1.0萬(wàn) 0

PCIe物理層的基本概念

需要注意的是，PCIe物理層處理可以轉(zhuǎn)發(fā)LTP和DLLP之外，還可以直接發(fā)送命令集（Ordered Sets）。之所以稱其為命令集，是因?yàn)樗⒉皇钦嬲?..

2018-05-02 標(biāo)簽：總線 PCIe 物理層 1.1萬(wàn) 0

一個(gè)簡(jiǎn)單地的例子來(lái)回顧PCIe總線的結(jié)構(gòu)、事務(wù)層、數(shù)據(jù)鏈路層和物理層

如下圖所示，Completer的應(yīng)用層會(huì)根據(jù)接受到的信息進(jìn)行相應(yīng)的處理，處理完成后會(huì)將數(shù)據(jù)發(fā)送至事務(wù)層，事務(wù)層根據(jù)這一信息創(chuàng)建一個(gè)新的TLP（即CplD...

2018-05-02 標(biāo)簽：總線 PCIe 9530 0

采用Flow Control機(jī)制的PCIe總線

PCIe總線為了解決這一問(wèn)題，提出了Flow Control的概念，如下圖所示。PCIe總線中要求接收方必須經(jīng)常（在特定時(shí)間）向發(fā)送方報(bào)告其VC Buf...

2018-04-26 標(biāo)簽：總線 PCIe 6314 0

詳細(xì)地聊一聊Non-Posted Transaction

Locked Read主要用于支持一種叫做Atomic Read-Modify-Write操作，這是一種高優(yōu)先級(jí)且不可被打斷的操作。主要用于測(cè)試鏈路狀況...

2018-04-25 標(biāo)簽：PCI總線總線 PCIe 8841 0

PCIe總線的通信機(jī)制

那么為什么要分為Non-Posted和Posted兩種類型呢？對(duì)于Memory Writes來(lái)說(shuō)，對(duì)效率要求較高，因此采用了Posted的方式。但是這并...

2018-04-24 標(biāo)簽：總線 PCIe 1.2萬(wàn) 0

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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