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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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基于FPGA的多種形式分頻的設(shè)計(jì)與實(shí)現(xiàn)
摘 要: 本文通過在QuartursⅡ開發(fā)平臺(tái)下,一種能夠?qū)崿F(xiàn)等占空比、非等占空比整數(shù)分頻及半整數(shù)分頻的通用分頻器的FPGA設(shè)計(jì)與實(shí)現(xiàn),介紹了利用VHDL硬件描
2009-06-20 標(biāo)簽:FPGA 687 0
基于FPGA的高頻時(shí)鐘的分頻和分配設(shè)計(jì)
摘要:介紹了為PET(正電子發(fā)射斷層掃描儀)的前端電子學(xué)模塊提供時(shí)間基準(zhǔn)而設(shè)計(jì)的一種新型高頻時(shí)鐘扇出電路。該電路利用FPGA芯片來實(shí)現(xiàn)對(duì)高頻時(shí)鐘的分頻
2009-06-20 標(biāo)簽:FPGA 1452 0
摘 要: 隨著VLSI的集成度越來越高,設(shè)計(jì)也越趨復(fù)雜。傳統(tǒng)的設(shè)計(jì)方法如原理圖輸入、HDL語言描述在進(jìn)行復(fù)雜系統(tǒng)設(shè)計(jì)時(shí),設(shè)計(jì)效率往往比較低。特別是在
2009-06-20 標(biāo)簽:FPGA 550 0
Verilog HDL語言在FPGA/CPLD開發(fā)中的應(yīng)用
摘 要:通過設(shè)計(jì)實(shí)例詳細(xì)介紹了用Verilog HDL語言開發(fā)FPGA/CPLD的方法,并通過與其他各種輸入方式的比較,顯示出使用Verilog HDL...
摘要:介紹了利用多種EDA工具進(jìn)行FPGA設(shè)計(jì)的實(shí)現(xiàn)原理及方法,其中包括設(shè)計(jì)輸入、綜合、功能仿真、實(shí)現(xiàn)、時(shí)序仿真、配置下載等具體內(nèi)容。并以實(shí)際操作介紹了
2009-06-20 標(biāo)簽:FPGA 631 0
由于半導(dǎo)體制造工藝的原因,低電壓器件的成本比傳統(tǒng)5V器件更低,性能更優(yōu),加上多數(shù)器件的I/O腳可以兼容5v/3.3v TTL電平,可以直接使用在原有系統(tǒng)...
概述 從FPGA或PLD轉(zhuǎn)換到門陣是經(jīng)濟(jì)高效的,有時(shí)甚至只需幾百個(gè)單元就能實(shí)現(xiàn)。這已經(jīng)引起越來越多設(shè)計(jì)者提出同樣的問...
2009-06-20 標(biāo)簽:FPGA 530 0
用多片F(xiàn)PGA 進(jìn)行ASIC 設(shè)計(jì)驗(yàn)證的分區(qū)和綜合技術(shù)
WCDMA文章列表:WiMAX與HSDPA優(yōu)勢(shì)比較? USB:淺談USB閃存盤與PIC微控制器系統(tǒng)的連接3G知識(shí)普及:3G研發(fā)歷史本文將介紹,如何在專...
2009-06-20 標(biāo)簽:fpga 1502 0
摘要:可編程外圍器件PSD應(yīng)用于單片機(jī)系統(tǒng)后,簡(jiǎn)化了單片機(jī)外圍電路的設(shè)計(jì),增加了系統(tǒng)的可靠性;利用PSD與單片機(jī)組成的系統(tǒng),通過計(jì)算機(jī)串口對(duì)FPGA進(jìn)行實(shí)時(shí)
2009-06-20 標(biāo)簽:fpga 670 0
用PowerPC860實(shí)現(xiàn)FPGA配置
摘要:介紹如何用PowerPC860(MPC860)進(jìn)行FPGA(Xilinx的Virtex-II系列)的配置;給出進(jìn)行FPGA配置所需的詳細(xì)時(shí)序圖和原...
2009-06-20 標(biāo)簽:fpga 1109 0
摘要:APA150是Actel公司推出的第二代基于Flash的可編程FPGA器件系列ProASIC Plus中的一種,非常適合替代ASIC用于航空、消費(fèi)...
2009-06-20 標(biāo)簽:fpga 1664 0
多種EDA工具的FPGA協(xié)同設(shè)計(jì)
摘 要:在FPGA開發(fā)的各個(gè)階段,市場(chǎng)為我們提供了很多優(yōu)秀的EDA工具。面對(duì)眼花繚亂的EDA工具,如何充分利用各種工具的特點(diǎn),并規(guī)劃好各種工具的協(xié)同使用...
2009-06-20 標(biāo)簽:FPGA 826 0
基于C語言的設(shè)計(jì)方式簡(jiǎn)化FPGA/協(xié)處理器混合平臺(tái)軟硬件協(xié)同
在最近幾年中日益流行在高性能嵌入式應(yīng)用中使用現(xiàn)場(chǎng)可編程門陣列(FPGA)。FPGA已經(jīng)被證明有能力處理各種不同的任務(wù),從相對(duì)簡(jiǎn)單的控制功能到更加復(fù)雜的算法操作
2009-06-20 標(biāo)簽:FPGA 628 0
基于Rocket I/O模塊的高速I/O設(shè)計(jì)
摘要: 介紹了采用Videx-ⅡPR0系列FPCA設(shè)計(jì)的應(yīng)用于下一代無線通信系統(tǒng)中的高速I/O。由于充分利用芯片中集成的Rocket I/O模塊,并采用...
一種基于嵌入式系統(tǒng)和Internet的FPGA動(dòng)態(tài)配置方案
摘要: 一種基于嵌入式系統(tǒng)和Inlternet的FPGA動(dòng)態(tài)配置方案。詳細(xì)介紹了該方案的設(shè)計(jì)思想,并給出了設(shè)計(jì)實(shí)例。與傳統(tǒng)的FPGA配置方案相比,該方案具有靈活
2009-06-20 標(biāo)簽:FPGA 571 0
新一代 FPGA的速度變得越來越快,密度變得越來越高,邏輯資源也越來越多。那么如何才能確保功耗不隨這些一起增加呢?很多設(shè)計(jì)抉擇可以影響系統(tǒng)的功耗,這些抉...
2009-06-20 標(biāo)簽:FPGA 2535 0
使用基于圖形的物理綜合加快FPGA設(shè)計(jì)時(shí)序收斂
傳統(tǒng)的綜合技術(shù)越來越不能滿足當(dāng)今采用 90 納米及以下工藝節(jié)點(diǎn)實(shí)現(xiàn)的非常大且復(fù)雜的 FPGA 設(shè)計(jì)的需求了。問題是
2009-06-20 標(biāo)簽:FPGA 747 0
ALTERA FPGA在微處理器系統(tǒng)中的在應(yīng)用配置
摘要: ALTERA公司SRAM工藝可編程器件應(yīng)用廣泛,專用配置器件比較昂貴。在具有微處理器的系統(tǒng)中,使用微處理器系統(tǒng)的存儲(chǔ)器來存儲(chǔ)配置數(shù)據(jù),并通過微處理器配
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