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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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DSP FPGA實(shí)時(shí)信號(hào)處理系統(tǒng)
摘要:簡(jiǎn)要敘述了常用的信號(hào)處理系統(tǒng)的類型與處理機(jī)結(jié)構(gòu),介紹了正逐步得到廣泛應(yīng)用的DSP+FPGA處理機(jī)結(jié)構(gòu),在此基礎(chǔ)上提出了一種實(shí)時(shí)信號(hào)處理的線性流水陣列,
固定幾何結(jié)構(gòu)的FFT算法及其FPGA實(shí)現(xiàn)
.引言DFT及其快速算法FFT是信號(hào)處理領(lǐng)域的核心組成部分。FFT算法多種多樣,按數(shù)據(jù)組合方式不同一般分時(shí)域和頻域,按數(shù)據(jù)抽取方式的不同又可分為基2,基...
基于FPGA的直接數(shù)字頻率合成技術(shù)設(shè)計(jì)
摘要: 介紹了利用現(xiàn)場(chǎng)可編程邏輯門陣列FPGA實(shí)現(xiàn)直接數(shù)字頻率合成(DDS)的原理、電路結(jié)構(gòu)和優(yōu)化方法。重點(diǎn)介紹了DDS技術(shù)在FPGA中的實(shí)現(xiàn)方法,給出...
2009-06-20 標(biāo)簽:FPGA 893 0
摘要:在對(duì)FFT(快速傅立葉變換)算法進(jìn)行研究的基礎(chǔ)上,描述了用FPGA實(shí)現(xiàn)FFT的方法,并對(duì)其中的整體結(jié)構(gòu)、蝶形單元及性能等進(jìn)行了分析。
2009-06-20 標(biāo)簽:FPGA 1278 0
摘要:采用FPGA實(shí)現(xiàn)四階IIR數(shù)字濾波器,通過兩個(gè)二階節(jié)級(jí)聯(lián)構(gòu)成數(shù)字橢圓低通濾波器。通帶內(nèi)波紋小于0.1dB,阻帶衰減大于32dB。
2009-06-20 標(biāo)簽:FPGA 2789 0
數(shù)字簽名算法SHA-1的FPGA高速實(shí)現(xiàn)
摘 要:隨著網(wǎng)絡(luò)的迅速發(fā)展,信息安全越來越重要,信息認(rèn)證是驗(yàn)證收到信息來源和內(nèi)容的基本技術(shù)。常用的信息驗(yàn)證碼是使用單向散列函數(shù)生成驗(yàn)證碼,
2009-06-20 標(biāo)簽:fpga 1805 0
數(shù)字頻率合成器的FPGA實(shí)現(xiàn)
摘要: 介紹了DDFS的原理和Altera公司的FPGA器件ACEX 1K的主要特點(diǎn),給出了用ACEX 1K系列器件EP1K10TC144-1實(shí)現(xiàn)數(shù)字頻...
2009-06-20 標(biāo)簽:FPGA 1080 0
利用FPGA技術(shù)實(shí)現(xiàn)數(shù)字通信中的交織器和解交織器
摘要:介紹用FPGA實(shí)現(xiàn)數(shù)字通信中的交、解交織器的一種比較通用的方案,詳細(xì)說明了設(shè)計(jì)中的一些問題及解決辦法。還介紹了一種實(shí)現(xiàn)FPGA中信號(hào)延時(shí)的方法。
2009-06-20 標(biāo)簽:FPGA 1459 0
用FPGA設(shè)計(jì)軟件無線電和調(diào)制解調(diào)器
本文以16-QAM RF發(fā)射數(shù)據(jù)泵的設(shè)計(jì)為例,介紹利用FPGA設(shè)計(jì)數(shù)字濾波器的技巧和器件選擇方法,說明執(zhí)行分布式計(jì)算時(shí)FPGA比DSP的優(yōu)越之處。 ...
2009-06-20 標(biāo)簽:FPGA 831 0
FPGA在多進(jìn)制正交擴(kuò)頻通信系統(tǒng)中的應(yīng)用
摘 要: 討論了高速無線分組網(wǎng)絡(luò)中多進(jìn)制正交擴(kuò)頻通信系統(tǒng)的設(shè)計(jì)和實(shí)現(xiàn),其中在系統(tǒng)核心部分的擴(kuò)頻編碼調(diào)制和解調(diào)等很多功能都由FPGA來完成,并對(duì)此進(jìn)行了詳...
2009-06-20 標(biāo)簽:FPGA 1201 0
同步數(shù)字體制(SDH)數(shù)字交叉連接(SDXC)矩陣的設(shè)計(jì)原理
要:介紹了一種基于現(xiàn)場(chǎng)可編程邏輯陣列(FPGA)的同步數(shù)字體制(SDH)數(shù)字交叉連接(SDXC)矩陣的設(shè)計(jì)原理,該矩陣可以實(shí)現(xiàn)2條STM-1輸入信號(hào)中1...
基于FPGA的直接數(shù)字頻率合成器的設(shè)計(jì)和實(shí)現(xiàn)
摘要:介紹了利用Altera的FPGA器件(ACEX EP1K50)實(shí)現(xiàn)直接數(shù)字頻率合成器的工作原理、設(shè)計(jì)思想、電路結(jié)構(gòu)和改進(jìn)優(yōu)化方法。 關(guān)鍵詞:直接數(shù)字
2009-06-20 標(biāo)簽:FPGA 724 0
基于模糊控制的遲早門同步器及其FPGA實(shí)現(xiàn)
摘要:介紹了遲早門同步器的基本工作原理,提出了在遲早門同步器中引入模糊邏輯控制獲得較小相位抖動(dòng)的方法,給出了遲早門同步器在FPGA上的
2009-06-20 標(biāo)簽:FPGA 895 0
自適應(yīng)算術(shù)編碼的FPGA實(shí)現(xiàn)
摘要: 在簡(jiǎn)單介紹算術(shù)編碼和自適應(yīng)算術(shù)編碼的基礎(chǔ)上,介紹了利用FPGA器件并通過VHDL語言描述實(shí)現(xiàn)自適應(yīng)算術(shù)編碼的過程。整個(gè)編碼系統(tǒng)在LTERA公司的...
2009-06-20 標(biāo)簽:FPGA 1273 0
摘 要 :本文結(jié)合各種實(shí)際測(cè)試介紹了羅德與施瓦茨公司的手持式頻譜儀R&S FSH在發(fā)射機(jī)與天饋線測(cè)試、無線電干擾查處以及電磁兼容診斷測(cè)試中的應(yīng)用。
2009-06-20 標(biāo)簽:FPGA 750 0
利用FPGA實(shí)現(xiàn)多路話音/數(shù)據(jù)復(fù)接設(shè)備
摘 要: 本文利用FPGA完成了8路同步話音及16路異步數(shù)據(jù)的復(fù)接與分接過程,并且實(shí)現(xiàn)了復(fù)接前的幀同步捕獲和利用DDS對(duì)時(shí)鐘源進(jìn)行分頻得到所需時(shí)鐘的過程。該設(shè)計(jì)
2009-06-20 標(biāo)簽:FPGA 695 0
使用Verilog實(shí)現(xiàn)基于FPGA的SDRAM控制器
摘 要:介紹了SDRAM的特點(diǎn)和工作原理,提出了一種基于FPGA的SDRAM控制器的設(shè)計(jì)方法,使用該方法實(shí)現(xiàn)的控制器可非常方便地對(duì)SDRAM進(jìn)行控制。 關(guān)鍵
錯(cuò)誤檢測(cè)與糾正電路的設(shè)計(jì)與實(shí)現(xiàn)
摘 要:針對(duì)一些惡劣的電磁環(huán)境對(duì)隨機(jī)存儲(chǔ)器(RAM)電路誤碼影響的情況,根據(jù)糾錯(cuò)編碼的基本原理,提出簡(jiǎn)單實(shí)用的能檢查兩位錯(cuò)誤并自動(dòng)糾正一位錯(cuò)誤的EDAC
基于CPLD/FPGA的半整數(shù)分頻器的設(shè)計(jì)
摘要:簡(jiǎn)要介紹了CPLD/FPGA器件的特點(diǎn)和應(yīng)用范圍,并以分頻比為2.5的半整數(shù)分頻器的設(shè)計(jì)為例,介紹了在MAX+plus II開發(fā)軟件下,利用VHD...
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