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      標(biāo)簽　>　fpga設(shè)計

      fpga設(shè)計

      fpga設(shè)計

      +關(guān)注9人關(guān)注

      FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。

      文章：348個 瀏覽：27307次 帖子：90個

      fpga設(shè)計技術(shù)

      芯片設(shè)計流程概要

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      芯片設(shè)計過程是一項復(fù)雜的多步驟工作，涉及從初始系統(tǒng)規(guī)格到制造的各個階段。

      2023-06-05 標(biāo)簽：處理器FPGA設(shè)計RISC 2042 0

      講解幾點關(guān)于FIFO IP核使用時的注意事項

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      FIFO？還是FIFO IP核？這也需要寫總結(jié)嗎？太容易了吧。如果我是一個正在處于面試找工作中的年輕人，肯定關(guān)注的是如何手撕FIFO，這也是當(dāng)時校招時候...

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      2018-12-19 標(biāo)簽：fpgaFPGA設(shè)計 2001 0

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      AMD-Xilinx在20nm & 16nm節(jié)點Ultrascale系列器件使用FinFET工藝，F(xiàn)inFET與Planar相比在相同速度條件下...

      2022-12-29 標(biāo)簽：FPGA設(shè)計asic晶體管 1998 0

      介紹一種ISE聯(lián)合仿真轉(zhuǎn)換為Moldelsim單獨仿真的方法

      找到仿真頂層的tb文件，cut_through_top_tb。

      2023-01-29 標(biāo)簽：FPGA設(shè)計asicModelSim 1996 0

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      2023-10-07 標(biāo)簽：FPGA設(shè)計CLK 1988 0

      fpga設(shè)計流程包含哪幾個部分

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      2023-07-03 標(biāo)簽：fpgaFPGA設(shè)計可編程芯片 1976 0

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      2023-04-27 標(biāo)簽：FPGA設(shè)計觸發(fā)器FPGA芯片 1976 0

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      在設(shè)計雙邊沿采樣電路（Dual-edge triggered flip-flop）之前，先從單邊沿采樣電路設(shè)計（Edge capture registe...

      2023-06-05 標(biāo)簽：FPGA設(shè)計寄存器采樣電路 1969 0

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      2022-09-19 標(biāo)簽：fpgaFPGA設(shè)計EDA工具 1965 0

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      本篇我們聚焦OFDM的基本原理，討論OFDM收發(fā)機的設(shè)計框架、調(diào)制與解調(diào)（IFFT/FFT）、正交性、保護間隔、循環(huán)前綴，并分析其優(yōu)缺點。

      2023-07-07 標(biāo)簽：FPGA設(shè)計通信系統(tǒng)SoC芯片 1918 0

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      2022-09-23 標(biāo)簽：FPGA設(shè)計接口HDL 1903 0

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      FPGA內(nèi)部表示正負(fù)數(shù)，小數(shù)的規(guī)則。兩者相比之下，定點數(shù)實現(xiàn)簡單，表達更為直觀，所以在很多時候FPGA通常使用定點數(shù)表示小數(shù)。

      2023-06-19 標(biāo)簽：fpgaFPGA設(shè)計計算機 1895 0

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      智能服務(wù)器適配器或智能網(wǎng)卡（SmartNIC）通過從服務(wù)器的CPU上卸載網(wǎng)絡(luò)處理工作負(fù)載和任務(wù)，提高云端和私有數(shù)據(jù)中心中的服務(wù)器性能。

      2023-07-27 標(biāo)簽：處理器fpgaFPGA設(shè)計 1880 0

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      IP(Intelligent Property) 核是具有知識產(chǎn)權(quán)核的集成電路芯核總稱，是經(jīng)過反復(fù)驗證過的、具有特定功能的宏模塊，與芯片制造工藝無關(guān)，可...

      2024-03-07 標(biāo)簽：FPGA設(shè)計寄存器EDA工具 1863 0

      如何脫離Vivado建立單獨仿真環(huán)境軟件呢？

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      FPGA項目開發(fā)的過程中，需要完成設(shè)計代碼開發(fā)、驗證環(huán)境搭建、仿真分析、板級驗證等操作，在這個過程中，許多操作雖然必不可少但是步驟是重復(fù)的。

      2023-09-27 標(biāo)簽：fpgaFPGA設(shè)計仿真 1855 0

      verilog整數(shù)四則運算的位寬考量簡介

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      加、減 使用補碼時，加減法可以統(tǒng)一，因而對加減不加區(qū)分，對有無符號也不加以區(qū)分。

      2023-06-06 標(biāo)簽：FPGA設(shè)計Verilog 1852 0

      RTL設(shè)計指導(dǎo)原則之面積和速度互換

      RTL設(shè)計指導(dǎo)原則之面積和速度互換

      一般來說，面積是一個設(shè)計所消耗的目標(biāo)器件的硬件資源數(shù)量或者ASIC芯片的面積。

      2023-06-05 標(biāo)簽：FPGA設(shè)計加法器RTL 1841 0

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      • Protues
        Protues
        +關(guān)注
        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
      • 靜電防護
        靜電防護
        +關(guān)注
        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
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        Altium Designer
        +關(guān)注
      • FPGA芯片
        FPGA芯片
        +關(guān)注
        FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。
      • ArduBlock
        ArduBlock
        +關(guān)注
        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強，編程門檻降低，即使沒有編程經(jīng)驗的人也可以嘗試給Arduino控制器編寫程序。
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        FPGA開發(fā)板
        +關(guān)注
        FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費者所需的新一代汽車。
      • PCB封裝
        PCB封裝
        +關(guān)注
        pcb封裝就是把 實際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進行調(diào)用。
      • QUARTUS II
        QUARTUS II
        +關(guān)注
        Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計輸入到硬件配置的完整PLD設(shè)計流程。
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        +關(guān)注
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        +關(guān)注
      • Artix-7
        Artix-7
        +關(guān)注
        　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
      • VHDL代碼
        VHDL代碼
        +關(guān)注
      • Protel 99 se
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        +關(guān)注
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        +關(guān)注
      • candence
        candence
        +關(guān)注
      • 面包板
        面包板
        +關(guān)注
        面包板是由于板子上有很多小插孔，專為電子電路的無焊接實驗設(shè)計制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
      • AXI
        AXI
        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
      • 特性阻抗
        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • 時鐘源
        時鐘源
        +關(guān)注
        時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英 晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
      • AD采樣
        AD采樣
        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
      • 驅(qū)動電流
        驅(qū)動電流
        +關(guān)注
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        Kintex-7
        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實現(xiàn)與其相當(dāng)性能，性價比提高了一倍，功耗降低了一半。
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        +關(guān)注
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        紅外觸摸屏
        +關(guān)注
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