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賽靈思技術

Xilinx FPGA普通IO作PLL時鐘輸入

普通IO可以通過BUFG再連到PLL的時鐘輸入上,但要修改PLL的設置 input clk的選項中要選擇"No Buffer";

2017-02-09 標簽：FPGA 賽靈思 Xilinx 7473 0

如何使用Vivado功能創(chuàng)建AXI外設

了解如何使用Vivado的創(chuàng)建和封裝IP功能創(chuàng)建可添加自定義邏輯的AXI外設，以創(chuàng)建自定義IP。

2018-11-29 標簽：賽靈思 ip vivado 7439 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載15：Spartan

所有的Spartan-6 FPGA有高性能的可配置SelectIO驅(qū)動器與接收器，支持非常廣泛的接口標準?？梢酝ㄟ^編程控制I/O的輸出強度、斜率以及片上...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 7392 0

何謂 AXI？關于AXI3/AXI4的相關基礎知識

引言近來，幾乎每個賽靈思 IP 都使用 AXI 接口。Zynq、Zynq MP、MicroBlaze 和全新的 Versal 處理器都無一例外使用 A...

2020-09-27 標簽：賽靈思 AXI AXI4 7190 0

為什么這些公司都采用 7 納米工藝的 CCIX 測試芯片

賽靈思、Arm、Cadence和臺積公司今日宣布計劃在 2018 年交付 7 納米 FinFET 工藝芯片。這一測試芯片旨在從硅芯片層面證明 CCIX ...

2017-09-25 標簽：賽靈思 7180 0

如何在Vivado Design Suite 中進行IP加密

此視頻概述了Vivado Design Suite中的IP加密。它涵蓋了IP加密工具流程，如何準備加密IP以及如何在Vivado中運行加密工具。

2018-11-20 標簽：賽靈思 ip design 6991 0

如何在在Vivado中使用Cadence IES模擬進行仿真

了解如何使用Vivado中的Cadence IES Simulator在MicroBlaze IPI設計中運行仿真。我們將演示如何編譯仿真庫，為IP...

2018-11-23 標簽：賽靈思仿真 vivado 6976 0

HDMI VCU118設計移植到VCU128開發(fā)板的步驟解析

簡介與視頻示例設計概覽許多視頻 IP 核都附帶有示例設計。這些設計用于 IP 演示，并提供示例以供您在自己的設計中使用 IP 核時作為參考。這些 I...

2020-11-20 標簽：HDMI 振蕩器賽靈思 6957 0

Vivado的HLx版本的兩大特色

部分重配置技術實現(xiàn)了動態(tài)可配置性，在切換設計中的某些部分時，其余部分還能繼續(xù)保持工作，完全不需停機，且?guī)缀醪挥绊懗杀九c開發(fā)時間。

2019-07-29 標簽：賽靈思靈活性芯片可靠性 6926 0

Zynq UltraScale+ RFSoC的功能特點與應用

在本演示視頻中，Xilinx討論了其Zynq?UltraScale+?RFSoC系列的產(chǎn)品詳細信息。

2018-11-21 標簽：轉(zhuǎn)換器賽靈思 rf 6906 0

賽靈思FPGA中LVDS差分高速傳輸?shù)膶崿F(xiàn)

低壓差分傳送技術是基于低壓差分信號(Low Volt-agc Differential signaling)的傳送技術，從一個電路板系統(tǒng)內(nèi)的高速信號傳送...

2017-02-11 標簽：FPGA 賽靈思 LVDS 6874 0

如何單獨打開Xilinx SDK項目工程

.PPR文件是PLANAHEAD的工程文件，在WINDOWS下面可以直接雙擊打開，PROJECT.cache PROJECT.data是項目產(chǎn)生的臨時文...

2017-02-09 標簽：賽靈思 ZYNQ SDK 6855 0

在QEMU軟件仿真器上運行Zynq UltraScale+ MPSoC

Xilinx展示了在QEMU軟件仿真器上運行的Zynq UltraScale + MPSoC。四核ARM Cortex-A53在SMP模式下運行4個...

2018-11-26 標簽：賽靈思 linux 仿真器 6840 0

Kintex-7 FPGA連接DDR3存儲器的接口功能演示

這展示了DDR3內(nèi)存的Kintex-7 FPGA接口功能。

2018-11-30 標簽：fpga ddr3 存儲器 6832 0

Xilinx PCIe DMA子系統(tǒng)的性能測試

本視頻介紹了設置和測試Xilinx PCIe DMA子系統(tǒng)性能的過程。

2018-11-27 標簽：賽靈思硬件 pcie 6765 0

XDC約束及物理約束的介紹

觀看視頻，了解和學習有關XDC約束，包括時序，以及物理約束相關知識。

2019-01-07 標簽：賽靈思語言時序 6738 0

詳解基于賽靈思的Versal? ACAP設計創(chuàng)建步驟

Versal ACAP（自適應計算加速平臺）是高度集成化的多核計算平臺，可通過靈活的自適應能力來滿足不斷變化的動態(tài)算法的需求。VCK190 是賽靈思最早...

2020-09-28 標簽：寄存器賽靈思算法 6619 0

Vivado 2014.1的下載與安裝概述

隨著Vivado 2014.1的發(fā)布，安裝將比以往更小，更快。您現(xiàn)在可以通過選擇，下載和僅安裝設計所需的組件來自定義安裝。

2018-11-29 標簽：賽靈思安裝 vivado 6604 0

說說賽靈思（Xilinx ）的FPGA 高速串行收發(fā)器

賽靈思（Xilinx）公司FPGA器件的高速串行收發(fā)器類別如下

2017-02-11 標簽：FPGA 賽靈思 Xilinx 6572 0

Xilinx SDK的全面高級概述

了解Xilinx SDK如何為您提供在Zynq全可編程器件上創(chuàng)建，開發(fā)，調(diào)試和部署嵌入式軟件應用所需的所有工具。該視頻為您提供了Xilinx SDK...

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