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標(biāo)簽 > 時(shí)鐘
時(shí)鐘是生活中常用的一種計(jì)時(shí)器，人們通過它來記錄時(shí)間。至今為止，在中國歷史上有留下記載的四代計(jì)時(shí)器分別為：日晷、沙漏、機(jī)械鐘、石英鐘。
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通過讓系統(tǒng)中的不同開關(guān)穩(wěn)壓器同步，可以緩解開關(guān)穩(wěn)壓器輸入端產(chǎn)生的輻射發(fā)射和傳導(dǎo)發(fā)射問題。許多DC－DC轉(zhuǎn)換器IC具有SYNC引腳，可將時(shí)鐘信號提供給該引...
2022-12-07 標(biāo)簽：轉(zhuǎn)換器穩(wěn)壓器開關(guān)穩(wěn)壓器 1289 0
在電路設(shè)計(jì)中，DAC時(shí)鐘通常是DAC中產(chǎn)生相位噪聲的首要原因。為什么這么說?本文將來做一些探討。
對于STM32這款單片機(jī)，現(xiàn)在是越來越多的人熟悉和使用它了。在很多的項(xiàng)目和產(chǎn)品中都有它的身影，以及現(xiàn)在很多的大學(xué)課程都是用STM32開展教學(xué)了，已經(jīng)是應(yīng)...
信號完整性 搞硬件還需要懂這些？ 工程師成長計(jì)劃第十期，認(rèn)識信號完整性。 ? 信號完整性（Signal Integrity，SI），通俗來講就是信號的質(zhì)...
2022-11-03 標(biāo)簽：電路設(shè)計(jì)信號時(shí)鐘 1601 0
定時(shí)器種類有基本定時(shí)器、通用定時(shí)器、高級控制定時(shí)器，以AT32F435xx舉例，下表為各種類型定時(shí)器的功能總表。本文主要就定時(shí)器溢出中斷進(jìn)行基礎(chǔ)講解和案列解析。
時(shí)鐘是芯片正確高效運(yùn)行的基礎(chǔ)，正確的時(shí)鐘配置是芯片能正確運(yùn)行的必要條件，其重要性不言而喻。AT32各系列產(chǎn)品的時(shí)鐘配置部分可能存在細(xì)微的差異和需要注意的...
這是一款超級馬里奧主題的時(shí)鐘，基于 ESP32 和彩色點(diǎn)陣制造，非常生動(dòng)有趣。使用 ESP32 來控制 LED 矩陣。對于沒法自制 PCB 板的新手來說...
時(shí)鐘是芯片正確高效運(yùn)行的基礎(chǔ)，正確的時(shí)鐘配置是芯片能正確運(yùn)行的必要條件，其重要性不言而喻。AT32各系列產(chǎn)品的時(shí)鐘配置部分可能存在細(xì)微的差異和需要注意的...
當(dāng) LUTRAM 讀寫使用不同的時(shí)鐘，寫時(shí)鐘 wclk_a，讀時(shí)鐘 rclk_b。
2022-10-21 標(biāo)簽：寄存器數(shù)據(jù)時(shí)鐘 1337 0
今天給大家分享兩點(diǎn)內(nèi)容： 一是，為什么我們要先開啟STM32外設(shè)時(shí)鐘；二是，關(guān)于STM32的 I/O 復(fù)用功能及什么時(shí)候開啟AFIO時(shí)鐘。
相信很多朋友都曾遇到過這種坑，我最初學(xué)習(xí)STM32的時(shí)候同樣也遇到過。下面，我就來說說為什么我們要先開啟STM32外設(shè)模塊時(shí)鐘，再對其外設(shè)模塊初始化配置？
什么是時(shí)鐘緩沖器（Buffer）？時(shí)鐘緩沖器（Buffer）參數(shù)解析
什么是時(shí)鐘緩沖器（Buffer）？時(shí)鐘緩沖器（Buffer）參數(shù)解析 什么是時(shí)鐘緩沖器（Buffer）？我們先把這個(gè)概念搞清楚。 時(shí)鐘緩沖器就是常說的C...
2022-10-18 標(biāo)簽：時(shí)鐘緩沖器pll時(shí)鐘 2.9萬 0
單元測試，一般是指基于開發(fā)人員自行開展的功能測試及各個(gè)功能單元的單元測試，是硬件信號級的測試，分為基本測試和信號完整性測試。也被稱作硬件的白盒測試。
perf 在內(nèi)核中的實(shí)現(xiàn)原理
我們在《一文看懂Linux性能分析｜perf 原理》一文中介紹過，perf 是基于采樣來對程序進(jìn)行分析的。采樣的步驟如下：
2022-10-17 標(biāo)簽：內(nèi)核數(shù)據(jù)時(shí)鐘 2921 0
i.MX RT10xx系列外部晶振相關(guān)引腳的作用
之前寫過一篇關(guān)于時(shí)鐘引腳的文章 《i.MX RT1xxx系列MCU時(shí)鐘相關(guān)功能引腳的作用》，里面簡單提及了外部晶振相關(guān)引腳的作用，但是并沒有詳細(xì)展開。
通常認(rèn)為當(dāng)信號的傳輸延時(shí)小于其上升時(shí)間（或者下降時(shí)間）的1/6的時(shí)候，該電路會(huì)呈現(xiàn)出分布系統(tǒng)的特性，也將該電路稱高速電路，相關(guān)的信號叫做高速信號。
前言 在上篇文章里《時(shí)序分析基本概念（一）——建立時(shí)間》，我們向大家介紹了建立時(shí)間的基本概念和計(jì)算方法。
我在知乎看到了多bit信號跨時(shí)鐘的問題，于是整理了一下自己對于跨時(shí)鐘域信號的處理方法。
2022-10-09 標(biāo)簽：數(shù)據(jù)時(shí)鐘XPM 7100 0
當(dāng)我剛開始我的FPGA設(shè)計(jì)生涯時(shí)，我對明顯更小、更不靈活的 FPGA（想想 XC4000XL / Clcyone3/4和 Spartan）和工具的非常簡...
顧名思義，output_delay就是指輸出端口的數(shù)據(jù)相對于參數(shù)時(shí)鐘邊沿的延時(shí)。
2022-09-26 標(biāo)簽：fpga數(shù)據(jù)時(shí)鐘 4289 0
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