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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>如何優(yōu)化 PCIe 應(yīng)用中的時鐘分配

      如何優(yōu)化 PCIe 應(yīng)用中的時鐘分配

      2022-11-07 | pdf | 309.03KB | 次下載 | 免費

      資料介紹

      PCI Express? (PCIe?) 是一項業(yè)界領(lǐng)先的標(biāo)準(zhǔn)輸入／輸出 (I/O) 技術(shù)，是服務(wù)器、個人電腦以及其它應(yīng)用中最常用的 I/O 接口之一。該標(biāo)準(zhǔn)多年來不斷發(fā)展，以適應(yīng)更高的數(shù)據(jù)速率（見表 1）。第 3 代 PCIe 引入了全新的編碼方案，其可在不增加數(shù)據(jù)速率一倍的情況下，將數(shù)據(jù)吞吐量提升一倍。PCI-SIG 近期宣布推出的第 4 代 PCIe 具有 16 G 每秒傳輸 (GT/s) 的比特率。第 4 代的規(guī)范預(yù)計將在 2014 或 2015 年發(fā)布。 表 1：各代 PCIe 的數(shù)據(jù)吞吐量 隨著數(shù)據(jù)速率的提升，參考時鐘需求也在不斷提高。本文將重點介紹參考時鐘需求。 PCIe 參考時鐘 (RefClk) 規(guī)范可針對 3 種不同架構(gòu)定義，分別是：數(shù)據(jù)時鐘、獨立 RefClk 以及通用 RefClk。每個架構(gòu)都具有特定的濾波器函數(shù)。在接收器時鐘數(shù)據(jù)恢復(fù)輸入端出現(xiàn)的有效抖動是接收器及發(fā)送器…
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