資料介紹
軟件架構(gòu):
僅包括 Verilog 文件和測(cè)試臺(tái),您可以在任何 FPGA 平臺(tái)上進(jìn)行仿真。
安裝教程:
1.在vivado中創(chuàng)建一個(gè)項(xiàng)目
2.使用實(shí)驗(yàn)室添加設(shè)計(jì)源?.srcs/sources_1/*
3.添加帶有實(shí)驗(yàn)室的測(cè)試臺(tái)?.srcs/sim_1/*
4.運(yùn)行模擬
5.您還可以在 quartus II 中添加設(shè)計(jì)文件
參與貢獻(xiàn):
1.Fork 本倉(cāng)庫(kù)
2.新建 Feat_xxx 分支
3.提交代碼
4.新建 Pull Request
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