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Verilog HDL門級(jí)結(jié)構(gòu)描述
用于門級(jí)描述關(guān)鍵字包括：not（非門）、and（與門）、 nand（與非門）、or（或門）、nor（或非門）、xor（異或門）、xnor（異或非門）、buf（緩沖器）以及bufif1、bufif0、 notif1、notif0等各種三態(tài)門。門級(jí)描述語(yǔ)句格式為 《門類型》 ［《驅(qū)動(dòng)能力》 《延時(shí)》 ］（門實(shí)例列表）； nand #10 nd1（a，data，clock，clear）; 使用了一個(gè)名為nd1的與非門，輸入為data、clock 、clear 。輸出為a，輸出與輸入的延時(shí)為10個(gè)時(shí)間單位
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