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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>如何抑制PLL雜散信號？談射頻電路的電源和接地設(shè)計技術(shù)

      如何抑制PLL雜散信號？談射頻電路的電源和接地設(shè)計技術(shù)

      2010-12-26 | rar | 658 | 次下載 | 10積分

      資料介紹

      射頻(RF)電路的電路板布局應(yīng)在理解電路板結(jié)構(gòu)、電源布線和接地的基本原則的基礎(chǔ)上進行。本文探討了相關(guān)的基本原則，并提供了一些實用的、經(jīng)過驗證的電源布線、電源旁路和接地技術(shù)，可有效提高RF設(shè)計的性能指標?？紤]到實際設(shè)計中PLL雜散信號對于電源耦合、接地和濾波器元件的位置非常敏感，本文著重討論了有關(guān)PLL雜散信號抑制的方法。為便于說明問題，本文以MAX2827802.11a/g收發(fā)器的PCB布局作為參考設(shè)計。

      設(shè)計RF電路時，電源電路的設(shè)計和電路板布局常常被留到了高頻信號通路的設(shè)計完成之后。對于沒有經(jīng)過認真考慮的設(shè)計，電路周圍的電源電壓很容易產(chǎn)生錯誤的輸出和噪聲，這會進一步影響到RF電路的性能。合理分配PCB的板層、采用星型拓撲的Vcc引線，并在Vcc引腳加上適當?shù)娜ヱ铍娙?，將有助于改善系統(tǒng)的性能，獲得最佳指標。

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