如何使用DSP和FPGA實(shí)現(xiàn)導(dǎo)航計(jì)算機(jī)系統(tǒng)的信息融合研究
資料介紹
本文首先簡單介紹某小型基于DSP 和FPGA 的導(dǎo)航計(jì)算機(jī)系統(tǒng),然后根據(jù)其子系統(tǒng)輸出的有效信息設(shè)計(jì)可行的信息融合算法; 針對其子系統(tǒng)有效輸出結(jié)果的時(shí)間不同步性,結(jié)合系統(tǒng)實(shí)際情況,設(shè)計(jì)一種中斷機(jī)制的同步實(shí)現(xiàn)方法;最后進(jìn)行仿真試驗(yàn),驗(yàn)證本文的設(shè)計(jì)。
設(shè)計(jì)了一種基于DSP和FPGA的導(dǎo)航計(jì)算機(jī)系統(tǒng), 它分三個(gè)子系統(tǒng): DSP導(dǎo)航計(jì)算機(jī)子系統(tǒng)、IMU(慣性測量組合)數(shù)據(jù)采集子系統(tǒng)和GPS接收機(jī)輸出數(shù)據(jù)采集子系統(tǒng)。在DSP導(dǎo)航計(jì)算機(jī)子系統(tǒng)中,建立以一片DSP芯片TMS320VC33為核心的微計(jì)算機(jī)系統(tǒng),主要完成導(dǎo)航計(jì)算、制導(dǎo)計(jì)算、卡爾曼濾波等所有數(shù)據(jù)處理任務(wù)。同時(shí),以一片CPLD作為該子系統(tǒng)與其他子系統(tǒng)擴(kuò)展連接的橋梁。此CPLD可以接受來自其他子系統(tǒng)的中斷信號,從而置位相應(yīng)的中斷標(biāo)志寄存器位并向DSP發(fā)中斷請求,以便DSP查詢處理。對于這個(gè)導(dǎo)航計(jì)算機(jī)系統(tǒng),配以相應(yīng)的慣性測量器件,就可以組成一個(gè)完整的小型捷聯(lián)慣性導(dǎo)航(SINS)/GPS 組合導(dǎo)航系統(tǒng)。
在組合導(dǎo)航系統(tǒng)中,要實(shí)現(xiàn)有效的信息融合,根據(jù)系統(tǒng)的實(shí)際情況來選擇設(shè)計(jì)數(shù)據(jù)融合算法是關(guān)鍵,但要保證算法成功,首先必須保證融合數(shù)據(jù)的時(shí)間同步。下面就針對這一組合導(dǎo)航系統(tǒng),研究相應(yīng)的信息融合算法,再進(jìn)行數(shù)據(jù)的時(shí)間同步研究,以保證信息融合的成功。
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