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電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>邏輯電平中邏輯互連的AC耦合電容

邏輯電平中邏輯互連的AC耦合電容

2021-01-07 | rar | 0.05 MB | 次下載 | 免費(fèi)

資料介紹

  本篇主要介紹邏輯互連中的AC耦合電容。

  1、AC耦合電容的作用

  source和sink端DC level不同,用來隔直流;

  信號傳輸時可能會串?dāng)_進(jìn)去直流分量,所以隔直流使信號眼圖更好。

  2、AC耦合電容的位置及大小

  一般AC耦合電容的位置和容值大小都是由信號的協(xié)議或者芯片供應(yīng)商去提供,對于不同信號和不同芯片,其位置和容值大小都是不一樣的。比如PCIE信號要求AC耦合電容靠近通道的發(fā)送端,SATA信號要求AC耦合電容靠近連接器處,對于10GBASE-KR信號要求AC耦合電容靠近信號通道的接收端。

  一般放在接收端,其原因如下:

  · 電容看成一個阻抗不連續(xù)點(所以要求盡量跟傳輸線匹配),如果靠近接收端放,相同的反射系數(shù)下,信號經(jīng)過通道衰減之后再反射會比一開始就反射的能量小。所以大多數(shù)的串行鏈路都要求靠接收端放。

  · 在信號傳輸過程中,也可能串?dāng)_進(jìn)去一些直流分量,導(dǎo)致接收出問題,所以靠近接收端。

  在設(shè)計過程中,最好的處理方式如下:

  · 優(yōu)先按照design guideline要求放置;

  · 如果沒有g(shù)uideline,如果是IC到IC,靠近接收端放置;

  · 如果是IC到連接器,靠近連接器放置;

  · 盡可能選擇小的封裝尺寸,減小阻抗不連續(xù);耦合電容的大小,一般0.1uF可以滿足到10G的應(yīng)用,具體的接口要求不一樣。

  在串行信號中串入AC耦合電容,這個電容可以提供直流偏壓和過電流保護(hù),但也會給鏈路帶來另一個問題PDJ(pattern-dependent jitter)。這和碼型有關(guān),鏈路可以等效成高通RC電路,當(dāng)出現(xiàn)連續(xù)的“1”或“0”時,會出現(xiàn)下圖的直流壓降,這不僅會影響眼高,還會造成PDJ。

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