資料介紹
在前面的實驗里,我們所有的實驗都是基于這樣一個觀點,即將一個數(shù)字系統(tǒng)劃分成合適利用已有的中小規(guī)模數(shù)字集成電路的功能的模塊,然后將這些集成電路通過外部引線連接起來?,F(xiàn)在開始我們將研究用可編程邏輯器件(PLD/FPGA)來進行數(shù)字系統(tǒng)設(shè)計??删幊踢壿嬈骷且环N大規(guī)模的集成電路,其內(nèi)部預(yù)置了大量易于實現(xiàn)各種邏輯函數(shù)的結(jié)構(gòu),同時還有一些用來保持信息或控制連接的特殊結(jié)構(gòu),這些保持的信息或連接確定了器件實現(xiàn)的實際邏輯功能,當(dāng)改變這些信息或連接時器件的功能也將隨之改變。可編程邏輯器件的設(shè)計過程和傳統(tǒng)的中小規(guī)模數(shù)字電路設(shè)計也不一樣,可編程數(shù)字系統(tǒng),無論是CPLD還是FPGA器件都需要利用軟件工具來進行設(shè)計??删幊虜?shù)字系統(tǒng)設(shè)計總體上一般可以分為設(shè)計輸入、項目處理、設(shè)計校驗和器件編程這四個主要過程。下面我們將一個簡單的模60BCD計數(shù)器為例,說明可編程數(shù)字系統(tǒng)設(shè)計的基本流程、概念和方法,掌握Quartus II軟件的基本功能和操作,了解原理圖輸入方式的設(shè)計全過程。
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