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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>利用格雷碼指針實(shí)現(xiàn)在多時(shí)鐘域傳遞數(shù)據(jù)的FIFO設(shè)計(jì)

      利用格雷碼指針實(shí)現(xiàn)在多時(shí)鐘域傳遞數(shù)據(jù)的FIFO設(shè)計(jì)

      2014-07-09 | pdf | 171KB | 次下載 | 1積分

      資料介紹

      在大規(guī)模集成電路設(shè)計(jì)中，一個(gè)系統(tǒng)包含了很多不相關(guān)的時(shí)鐘信號(hào)，當(dāng)其目標(biāo)域時(shí)鐘與源域時(shí)鐘不同時(shí)，如何在這些不同域之間傳遞數(shù)據(jù)成為了一個(gè)重要問(wèn)題。為了解決這個(gè)問(wèn)題，我們可以用一種異步 FIFO（先進(jìn)先出）存儲(chǔ)器來(lái)實(shí)現(xiàn)。本文介紹了一種利用格雷碼指針實(shí)現(xiàn)在多時(shí)鐘域傳遞數(shù)據(jù)的FIFO設(shè)計(jì)。 
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