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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>VHDL語(yǔ)言概述

      VHDL語(yǔ)言概述

      2009-08-09 | rar | 222 | 次下載 | 5積分

      資料介紹

      VHDL語(yǔ)言概述:本章主要內(nèi)容：
      ??硬件描述語(yǔ)言（HDL）
      ??VHDL語(yǔ)言的特點(diǎn)
      ??VHDL語(yǔ)言的開(kāi)發(fā)流程

      1.1 1.1 硬件描述語(yǔ)言（ 硬件描述語(yǔ)言（HDL HDL）
      ??HDL語(yǔ)言的產(chǎn)生
      ??HDL語(yǔ)言的種類
      ??VHDL語(yǔ)言的發(fā)展歷史

      一、 一、HDL HDL語(yǔ)言的產(chǎn)生（ 語(yǔ)言的產(chǎn)生（1）
      1、硬件描述語(yǔ)言產(chǎn)生的原因：
      a、集成電路的高速發(fā)展：速度快、性能高、容量大、體積小、微功耗。
      b、可編程邏輯器件的大量使用：CPLD、FPGA。
      c、傳統(tǒng)電路設(shè)計(jì)方法的缺點(diǎn)：
      采用布爾方程或者門(mén)級(jí)描述，導(dǎo)致設(shè)計(jì)復(fù)雜；模擬與調(diào)試后期進(jìn)行，需要反復(fù)修改電路；設(shè)計(jì)文件為電路原理圖，數(shù)量大、管理不便。
      d、業(yè)界技術(shù)人員的共同目標(biāo)——尋求新的電路設(shè)計(jì)方法來(lái)代替?zhèn)鹘y(tǒng)的電路設(shè)計(jì)方法。

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