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      電子發(fā)燒友網(wǎng)>電子資料下載>電路圖紙>信號處理電路>混合型電路的內(nèi)裝式自測試(BIST)結(jié)構(gòu)

      混合型電路的內(nèi)裝式自測試(BIST)結(jié)構(gòu)

      2010-08-06 | rar | 444 | 次下載 | 5積分

      資料介紹

      隨著超大規(guī)模集成電路(VLSI)制造密度的提高．使得電子電路和系統(tǒng)變得日益復(fù)雜．也顯著地拉加了模擬和數(shù)字集成電路充分測試的難度．另外．市場競爭的壓力對集成電路(Ic)的-惻試質(zhì)量和工作周期的加快都提出更高要求。由于Ic測試往往關(guān)系到項目的成敗，故而Ic測試常占到IC開發(fā)周期的近1/3。
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