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ADRF6780 5.9 至23.6GHz、寬帶微波上變頻器技術手冊

要長高 ? 2025-03-28 09:12 ? 次閱讀
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概述
ADRF6780是一款采用硅鍺(SiGe)設計的寬帶、微波變頻器,針對點到點微波無線電設計進行優(yōu)化,工作頻率范圍為5.9 GHz至23.6 GHz。

該上變頻器提供兩種頻率轉換模式。該器件能夠從基帶I/Q輸入信號直接變頻為射頻(RF),也能夠從實中頻(IF)輸入載波頻率單邊帶(SSB)上變頻。基帶輸入為高阻態(tài),通常采用100 Ω差分后部端接電阻接進行片外端接??山没鶐/Q輸入路徑,并將0.8 GHz至3.5 GHz范圍內(nèi)的任何調(diào)制實IF信號饋入IF輸入路徑且上變頻為5.9 GHz至23.6 GHz,同時抑制典型優(yōu)于25 dBc的無用邊帶。串行端口接口(SPI)支持正交相位調(diào)整的調(diào)節(jié),以實現(xiàn)較佳邊帶抑制性能。此外,SPI接口在無需功率監(jiān)控時可關斷輸出功率檢測器以便降低功耗。

ADRF6780上變頻器采用緊湊的散熱增強型、5 mm × 5 mm LFCSP封裝。ADRF6780工作溫度范圍為?40°C至+85°C。
數(shù)據(jù)表:*附件:ADRF6780 5.9 至23.6GHz、寬帶微波上變頻器技術手冊.pdf

應用

  • 點對點微波無線電
  • 雷達、電子戰(zhàn)系統(tǒng)
  • 儀器儀表、自動測試設備(ATE)

特性

  • 寬帶RF輸出頻率范圍:5.9 GHz至23.6 GHz
  • 兩種上變頻模式
    • 從基帶IQ直接變頻至RF
    • 從實IF單邊帶上變頻
  • LO輸入頻率范圍:5.4 GHz至14 GHz
  • LO倍頻器最高可達28 GHz
  • 匹配100 ?平衡RF輸出、LO 輸入和IF輸入
  • 高阻抗基帶輸入
  • 邊帶抑制和載波饋通優(yōu)化
  • 用于Tx功率控制的可變衰減器和功率檢測器
  • 可通過四線式SPI接口編程
  • 32引腳LFCSP 5 mm × 5 mm微波封裝

框圖image.png
引腳配置描述
image.png

image.png

典型性能特征
image.png

工作原理

ADRF6780是一款寬帶微波上變頻器,針對5.9 GHz至23.6 GHz射頻范圍的功能點到點微波無線電設計進行了優(yōu)化。設備的功能框圖如圖1所示。ADRF6780通過SPI進行編程。
image.png

基帶

基帶的輸入阻抗為高輸入阻抗。這些輸入設計為在0.5 V共模電壓下工作。這些輸入通過100 Ω電阻進行差分終端匹配。

通過添加相位校正信號到當前輸出電壓調(diào)整[1]_PATH_PHASE_ACCURACY寄存器(0x05,Bits[3:0])和Q_PATH_PHASE_ACCURACY寄存器(0x05,Bits[7:4]),可以優(yōu)化線性度。

單路單邊帶(SSB)上變頻

如果IF輸入帶寬可以在0.8 GHz至3.5 GHz之間變化。IF輸入路徑可以上變頻到5.9 GHz至23.6 GHz,同時抑制不需要的單邊帶,理論上比所需單邊帶低25 dBc。IF上變頻輸入為100 Ω差分輸入,必須交流耦合。此外,I/Q基帶輸入必須保持浮空,任何射頻感應都應在內(nèi)部處理。

本振(LO)輸入路徑

LO路徑的工作頻率范圍為5.4 GHz至14 GHz,LO幅度范圍為-6 dBm至+6 dBm。它有兩種模式:

  • ×1模式(寄存器0x03,Bit 2),提供與LO輸入頻率相同的LO輸出頻率。
  • ×2模式(寄存器0x03,Bit 3),將LO輸入頻率加倍以產(chǎn)生LO輸出頻率。注意,當啟用LO ×2模式(寄存器0x03,Bit 3)時,LO ×1模式(寄存器0x03,Bit 2)將被禁用。

LO路徑設計為差分工作。LOIP和LOIN與LO路徑差分連接。建議將ADRF6780的LO輸入差分匹配,以獲得最佳性能。

圖67展示了LO路徑的框圖。
image.png

串行端口接口(SPI)

ADRF6780的SPI允許用戶通過4線SPI端口對設備進行配置,以實現(xiàn)特定功能或操作。該接口為用戶提供了更高的靈活性和定制性。SPI由四條控制線組成:SCLK、SDIN、SDTO和SEN。

ADRF6780協(xié)議由一個讀寫位和16位串行寫入數(shù)據(jù)組成,最高有效位(MSB)在前,最低有效位(LSB)在后。對于寫入操作,將第一位設為0;對于讀取操作,將此位設為1。

寫入周期采樣必須在上升沿進行。16位串行寫入數(shù)據(jù)從MSB到LSB移位進入。ADRF6780寫入周期的輸入邏輯電平支持1.8 V。

對于讀取周期,最多16位串行讀取數(shù)據(jù)被移出,MSB在前。在數(shù)據(jù)移出后,奇偶校驗位移出。輸出邏輯電平為1.8 V。

奇偶校驗位始終跟隨數(shù)據(jù)的方向。如果不使用奇偶校驗位,則傳輸零而不是奇偶校驗位。設備在命令期間傳輸?shù)目偽粩?shù),包括讀取/寫入位、傳輸?shù)刂?、?shù)據(jù)位和奇偶校驗位,必須為16位。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權轉載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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