基于嵌入式RISC-V處理器核輕松實現(xiàn)DSP擴展設計
→ Codasip Studio and RISC-V 處理器核
從標準處理器核開始，無需“冷啟動”
? 基于已開發(fā)的嵌入式或應用處理器核 (如L31等）
? 高質量水準，達量產標準
? 完全符合RISC-V規(guī)范
通過Codasip Studio實現(xiàn)您需要的差異化
? 可配置/可定制
? 使用CodAL體系結構描述語言（類C高級語言）
→ 用CodAL實現(xiàn)DSP加速器
→ DSP定制如何影響PPA
基于嵌入式RISC-V核定制專用DSP，以處理如上四種代表性的DSP算法為例。性能和能耗分別提升和縮減為14.4倍和0.27倍（FFT），14.4倍和0.1倍（FIR）、30倍和0.03倍（Median filtering）和24.3倍和0.08倍（Cordic），通過增加有限的面積即得到了此效果。
使用CodAL和Codasip Studio，通過“開箱即用”的SDK和HDK等自動生成工具，結合精練的內核描述，輕松實現(xiàn)RISC-V的定制，縮短產品開發(fā)周期。下表列出了實現(xiàn)上述的DSP定制的預估代碼量和工作量。
審核編輯：劉清
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原文標題：基于嵌入式RISC-V處理器核 輕松實現(xiàn)DSP擴展設計
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