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臺(tái)積電3nm制程預(yù)計(jì)下半年試產(chǎn)量產(chǎn)

lhl545545 ? 來(lái)源:CNMO ? 作者:任澤宇 ? 2021-02-21 10:49 ? 次閱讀
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臺(tái)積電董事長(zhǎng)劉德音近日受邀于2021年國(guó)際固態(tài)電路會(huì)議(ISSCC 2021)開(kāi)場(chǎng)線(xiàn)上專(zhuān)題演說(shuō)時(shí)指出,臺(tái)積電3nm制程依計(jì)劃推進(jìn),甚至比預(yù)期還超前了一些。3nm及未來(lái)主要制程節(jié)點(diǎn)將如期推出并進(jìn)入生產(chǎn)。臺(tái)積電3nm制程預(yù)計(jì)今年下半年試產(chǎn),明年下半年進(jìn)入量產(chǎn)。

劉德音指出半導(dǎo)體制程微縮腳步并未減緩,摩爾定律仍然有效,臺(tái)積電3nm比預(yù)期進(jìn)度超前,至于2nm之后的電晶體架構(gòu)將轉(zhuǎn)向環(huán)繞閘極(GAA)的nm片(nano-sheet)架構(gòu),而極紫外光(EUV)技術(shù)可支持到1nm。

臺(tái)積電2020年推出5nm制程并進(jìn)入量產(chǎn),與7nm相較,邏輯密度提升1.83倍,運(yùn)算速度增加13%,運(yùn)算功耗下降21%。臺(tái)積電預(yù)計(jì)2022年推出3nm制程,與5nm相較邏輯密度提升1.7倍,運(yùn)算速度提升11%且運(yùn)算功耗可減少27%。

臺(tái)積電日前宣布將在日本成立研發(fā)中心擴(kuò)展3D IC材料研究,劉德音也提及臺(tái)積電在新材料上的技術(shù)創(chuàng)新,包括六方氮化硼(hBN)已接近實(shí)現(xiàn)量產(chǎn)。他強(qiáng)調(diào),系統(tǒng)整合是半導(dǎo)體未來(lái)發(fā)展方向,Chiplet(小芯片)是能讓技術(shù)朝向正確方向發(fā)展的關(guān)鍵,而臺(tái)積電的SoIC先進(jìn)封裝技術(shù)可實(shí)現(xiàn)3D芯片堆迭。
責(zé)任編輯:pj

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