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      AXI-4 Lite接口協(xié)議仿真波形解析

      FPGA技術(shù)驛站 ? 來(lái)源：搜狐網(wǎng) ? 作者：搜狐網(wǎng) ? 2020-09-23 11:18 ? 次閱讀
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      AXI-4 Lite可以看作是AXI-4 Memory Mapped的子集，從下面的示例圖中就可見(jiàn)一斑。最直接的體現(xiàn)是AXI-4 Lite的突發(fā)長(zhǎng)度是固定值1。

      AXI-4 Lite的接口信號(hào)如下圖所示。同樣都是5個(gè)獨(dú)立通道，但由于突發(fā)長(zhǎng)度被限制為1，使得某些信號(hào)不再需要，例如ARLEN和AWLEN就不再需要了，因?yàn)閮烧呔鶠?，同時(shí)用于顯示突發(fā)類(lèi)型（Burst Type）的ARBURST和AWBURST、表明一筆數(shù)據(jù)交易的最后一個(gè)有效數(shù)據(jù)WLAST和RLAST均不再需要了。此外，AXI-4 Lite要求數(shù)據(jù)位寬必須是32-bit或64-bit，故ARSIZE和AWSIZE也不再需要了。

      就數(shù)據(jù)傳輸機(jī)制而言，AXI-4 Lite和AXI-4 Memory Mapped是一致的，每個(gè)通道都有相應(yīng)的VALID和READY信號(hào)對(duì)。

      這里我們給出一個(gè)仿真波形供大家參考，以便理解AXI-4 Lite接口協(xié)議。

      寫(xiě)地址通道

      寫(xiě)數(shù)據(jù)通道

      寫(xiě)響應(yīng)通道

      讀地址通道

      讀數(shù)據(jù)通道

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      • 接口協(xié)議
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      原文標(biāo)題：AXI-4 Lite與AXI-4 Memory Mapped接口協(xié)議有什么區(qū)別？

      文章出處：【微信號(hào)：Lauren_FPGA，微信公眾號(hào)：FPGA技術(shù)驛站】歡迎添加關(guān)注！文章轉(zhuǎn)載請(qǐng)注明出處。

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